System-Level Isolation for Mixed-Criticality RISC-V SoCs: A "World" Reality Check
본 논문은 혼합 임계치(mixed-criticality) SoC를 위한 RISC-V 하드웨어 격리 프리미티브에 대한 비교 분석 및 실질적 구현을 제시하며, 수정된 월드 기반 체커(World-based checker)가 대안들보다 우수한 최악의 경우 지연 시간(worst-case latency), 예측 가능한 확장성 및 최대 5%의 면적 감소를 제공함을 입증함으로써 향후 규격 비준 및 SoC 설계에 관한 정보를 제공한다.
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현대 전자 공학의 세계에서 단일 칩은 당신이 운전하는 자동차부터 그 자동차를 만드는 공장 로봇에 이르기까지 모든 것의 두뇌 역할을 수행하곤 합니다. 시스템 온 칩(System-on-Chip)으로 알려진 이 칩들은 서로 협력하며 작동하는 다양한 부품들로 가득 차 있습니다. 어떤 것들은 단순한 작업을 처리하고, 다른 것들은 생명과 직결된 안전 기능을 관리합니다. 이러한 시스템을 안전하게 유지하기 위해, 엔지니어들은 저순위 부품에서의 실수나 악의적인 공격이 고순위 부품으로 확산되지 않도록 보장해야 합니다. 이를 비유하자면, 우편실, 임원실, 서버실이 모두 같은 복도를 공유하는 바쁜 사무실 건물과 같습니다. 만약 우편실이 침입당한다면, 보안 시스템은 침입자가 서버실에 도달하는 것을 막아야 합니다. 수십 년 동안 컴퓨터 칩은 이러한 보이지 않는 벽을 만들기 위해 종종 독점적인 특정 방법들에 의존해 왔으나, 이러한 중요한 역할들을 위해 오픈 소스인 RISC-V 아키텍처가 인기를 얻어감에 따라, 엔지니어들은 이러한 벽을 구축하기 위한 현재의 도구들이 미래를 위해 충분히 강력하고, 빠르며, 유연한지에 대해 질문을 던지고 있습니다.
포르투갈과 독일의 대학 및 산업 파트너들로 구성된 연구팀은 RISC-V 생태계 내에서 이러한 보안 벽에 대한 최신 제안들을 조사하기 위해 나섰습니다. 그들은 칩의 서로 다른 부분 사이의 무단 접근을 차단하기 위해 설계된 세 가지 특정 방법에 집중했습니다. 첫 번째 방법인 IOPMP는 모든 요청을 데이터베이스와 대조하여 허용 여부를 확인하는 상세한 규칙 목록처럼 작동합니다. 두 번째로 알려진 월드 체커(World Checker)는 각 요청에 "월드(world)" 라벨을 할당하고 시스템이 해당 라벨이 특정 구역에 진입할 수 있는지 확인하는 더 단순하고 빠른 접근 방식을 사용합니다. 세 번째인 SmMTT는 소프트웨어 도메인을 격리하지만 다른 관리 스타일을 사용하는 새로운 제안입니다. 연구진은 이 세 가지 시스템의 작동하는 하드웨어 버전을 구축하고, 아주 작은 지연조차 안전 실패를 초래할 수 있는 실시간 시스템의 엄격한 요구 사항 아래에서 이들이 어떻게 성능을 발휘하는지 확인하기 위해 시뮬레이션된 컴퓨터 칩 내부에서 테스트했습니다.
연구팀은 이러한 보안 체크의 속도와 예측 가능성이 크게 다르다는 것을 발견했습니다. 표준 형태의 월드 체커는 가장 일관된 성능을 보여주었습니다. 그것은 모든 트랜잭션에 고정된 미세한 지연을 추가했는데, 이는 규칙의 개수와 상관없이 시스템이 보안 체크에 걸리는 시간을 항상 정확하게 예측할 수 있음을 의미합니다. 이러한 예측 가능성은 타이밍이 정확해야 하는 자동차 브레이크 시스템과 같은 안전 필수 애플리케이션에 매우 중요합니다. 반면, IOPMP 방식은 유연하지만 가변적인 지연을 발생시켰습니다. 그 속도는 규칙이 목록의 어디에 위치하느냐에 따라 달라졌습니다. 즉, 규칙이 목록 깊숙이 있다면 시스템은 그것을 찾는 데 더 오래 기다려야 했습니다. 이러한 예측 불가능성은 비상 상황 중에 안전 시스템이 제때 반응하는 것을 보장하기 어렵게 만듭니다. 또한 연구진은 월드 체커가 보안 규칙의 수가 적을 때 칩 상의 물리적 자원을 더 적게 사용한다는 것을 발견했으며, 이는 단순한 설계를 위한 효율적인 선택임을 보여주었습니다.
하지만 연구진은 표준 월드 체커가 다양한 보안 구역을 가진 복잡하고 현대적인 칩을 다룰 때 한계가 있다는 점을 깨달았습니다. 기존 설계는 별도의 보안 식별자 수가 많아질 때 효율적으로 확장하는 데 어려움을 겪었으며, 필요한 것보다 더 많은 공간을 요구했습니다. 이를 해결하기 위해 연구팀은 월드 체커를 재설계했습니다. 그들은 더 많은 보안 식별자를 처리하면서도 칩의 크기를 부풀리지 않는 새로운 버전을 만들었습니다. 이 수정된 체커는 메모리 영역을 정의하는 더 유연한 방법을 도입하여, 엔지니어들이 공간을 낭비하지 않고도 흩어져 있거나 불규칙한 모양의 메모리 영역을 보호할 수 있게 했습니다. 또한 그들은 권한이 저장되는 방식도 변경하여, 하나의 커다란 데이터 블록을 더 작고 구체적인 항목들로 대체했습니다. 이 변화는 보안 식별자의 수가 증가함에 따라 수정된 체커가 효율성을 유지할 수 있게 한 반면, 표준 버전은 너무 커졌을 것입니다.
연구진이 이 새로운 설계들을 테스트했을 때, 결과는 미래의 칩 개발을 위한 명확한 경로를 보여주었습니다. 수정된 월드 체커는 기존의 빠르고 예측 가능한 속도를 유지하면서도 시스템이 더 복잡해짐에 따라 훨씬 더 잘 확장되었습니다. 전체 컴퓨터 칩 시뮬레이션에서 연구진은 자신들의 개선된 설계를 사용하면 베이스라인 설계와 비교하여 보안 시스템에 필요한 총 물리적 면적을 최대 5%까지 줄일 수 있다고 추정했습니다. 5%라는 수치가 작아 보일 수 있지만, 공간이 귀중하고 수백만 개의 칩이 생산되는 칩 제조의 세계에서 이 절감량은 상당한 비용 절감과 동일한 크기에 더 많은 기능을 담을 수 있는 능력으로 이어집니다. IOPMP 방식은 방대한 수의 식별자를 지원할 수 있음에도 불구하고, 지속적으로 더 많은 공간을 요구하고 더 많은 가변적 지연을 유발하여, 엄격한 타이밍 요구 사항을 가진 안전 필수 시스템에는 덜 적합했습니다.
본 연구는 차세대 RISC-V 칩, 특히 자동차와 산업 기계에 사용되는 칩들을 위해 월드 체커 방식이 가장 신뢰할 수 있는 토대를 제공한다고 결론짓습니다. 연구진의 수정 사항은 기존 설계의 약점을 해결하여, 이 칩들이 더 강력해지고 더 복합적인 작업을 처리하게 됨에 따라 보안 시스템이 속도나 안전을 희생하지 않고도 함께 성장할 수 있도록 보장합니다. 하드웨어 설계와 테스트 결과를 공개함으로써, 연구팀은 공식적인 RISC-V 표준에 영향을 미쳐 최종 사양이 이러한 효율적이고 예측 가능하며 확장 가능한 보안 메커니즘을 지원하도록 만들기를 희긋합니다. 그들의 작업은 안전한 오픈 소스 컴퓨팅의 미래가 속도와 확실성을 모두 갖추어 서로 다른 작업들을 격리할 수 있는 시스템, 즉 침해된 구성 요소의 혼란이 전체 기계를 무너뜨리는 것을 방지할 수 있는 시스템에 있다는 것을 시사합니다.
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