Energy Efficient Exact and Approximate Systolic Array Architecture for Matrix Multiplication

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Imagine que você tem uma equipe de cozinheiros (os Processadores) trabalhando em uma cozinha gigante para preparar um banquete complexo (os cálculos de Inteligência Artificial).

O problema é que, na cozinha tradicional, cada cozinheiro é extremamente perfeccionista. Eles medem cada grama de sal com uma balança de precisão cirúrgica e contam cada gota de óleo. Isso garante que o prato saia perfeito, mas consome muita energia, demora muito e exige equipamentos caros e grandes. Em dispositivos pequenos, como celulares ou sensores de casas inteligentes, essa cozinha "perfeita" gasta tanta bateria que o dispositivo morre rápido.

Este artigo apresenta uma nova forma de organizar essa cozinha: a Matriz Sistólica (uma fileira de cozinheiros que passam os ingredientes uns para os outros em ritmo constante).

Aqui está a explicação do que os autores fizeram, usando analogias do dia a dia:

1. A Ideia Principal: "Bastante Bom" vs. "Perfeito"

Os autores criaram dois tipos de cozinheiros (chamados de PEs ou Elementos de Processamento):

O Cozinheiro Perfeito (Exato): Faz tudo com precisão absoluta. É ótimo para quando você não pode errar nem um pouco.
O Cozinheiro "Aproximado" (Aproximado): Este é o herói da história. Ele é inteligente o suficiente para saber que, na maioria das vezes, não precisamos de precisão cirúrgica. Se a receita pede "um pouco de sal", ele não mede miligramas; ele joga um pouco e segue em frente.

A Mágica: Ao usar esses cozinheiros "aproximados", a cozinha gasta menos energia (até 68% menos!) e ocupa menos espaço, porque os equipamentos são mais simples.

2. As Ferramentas Novas: PPC e NPPC

Para fazer isso funcionar, eles inventaram duas ferramentas novas para os cozinheiros:

PPC (Célula de Produto Parcial): Uma ferramenta que ajuda a multiplicar números de forma mais eficiente.
NPPC (Célula de Produto Parcial com NAND): Uma versão ainda mais econômica dessa ferramenta, que usa lógica simplificada (como um atalho na receita).

Pense nelas como facas de cozinha mais afiadas e leves. A versão "aproximada" dessas facas é tão eficiente que, mesmo fazendo um corte ligeiramente diferente do padrão, o resultado final do prato (a imagem ou o cálculo) continua delicioso para quem come.

3. Onde isso é usado? (A Prova de Fogo)

Os autores testaram essa nova cozinha em três situações reais:

Comprimir Fotos (DCT): Imagine tentar enviar uma foto pelo WhatsApp. O sistema precisa reduzir o tamanho do arquivo.
- Resultado: Mesmo usando os cozinheiros "aproximados", a foto enviada ficou com qualidade quase idêntica à original (uma nota de qualidade de 45,97 em uma escala onde 100 é perfeito). O usuário nem percebeu a diferença, mas o celular gastou muito menos bateria.
Encontrar Bordas em Imagens (Detecção de Bordas): Imagine um sistema de segurança tentando identificar onde termina o céu e começa o prédio em uma foto.
- Método 1 (Receita Clássica): Usando um filtro simples, a qualidade caiu um pouco, mas ainda foi aceitável.
- Método 2 (Rede Neural/CNN): Aqui, eles usaram uma "inteligência artificial" que aprende com os erros. Mesmo com os cozinheiros "aproximados" fazendo cálculos rápidos e com pequenos erros, a rede neural corrigiu o caminho. O resultado foi incrível (nota de 75,98), mostrando que a estrutura inteligente compensa as pequenas falhas dos cozinheiros.

4. Por que isso é importante?

Hoje, queremos que nossos carros autônomos, óculos de realidade aumentada e assistentes de voz funcionem por dias sem recarregar.

O Problema: Os chips atuais são como cozinhas de 5 estrelas: potentes, mas famintas por energia.
A Solução: Este novo design é como uma cozinha móvel eficiente. Ele sacrifica um pouco de "perfeição matemática" (que o olho humano ou a IA nem notam) em troca de muita economia de energia.

Resumo Final

Os pesquisadores criaram uma nova arquitetura de chip que permite fazer cálculos pesados (como os usados em Inteligência Artificial) gastando muito menos energia. Eles fizeram isso criando cozinheiros que sabem quando podem "pular etapas" sem estragar o prato final.

A lição: Às vezes, para ser mais eficiente e rápido, não precisamos ser 100% perfeitos em cada detalhe; precisamos apenas ser "suficientemente bons" para o objetivo, e isso economiza uma fortuna de energia.

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1. O Problema

As Redes Neurais Profundas (DNNs) e outras aplicações de Inteligência Artificial dependem massivamente de multiplicações de matrizes (operações MAC - Multiply-Accumulate) para treinamento e inferência.

Desafio de Energia e Área: As arquiteturas convencionais de Arrays Sistolicos (SA) utilizam unidades aritméticas exatas, o que resulta em alto consumo de energia e grande sobrecarga de área de silício.
Limitação de Implantação: Essas ineficiências dificultam a implementação de aceleradores de IA em plataformas com recursos limitados, como dispositivos de borda (edge devices) e sistemas de Internet das Coisas (IoT), onde a eficiência energética é crítica.
Necessidade: Existe uma demanda por arquiteturas que troquem precisão absoluta por ganhos significativos em eficiência energética, mantendo a qualidade aceitável para aplicações tolerantes a erros (como processamento de imagem).

2. Metodologia

Os autores propõem uma arquitetura de Array Sistolico (SA) que incorpora novos Elementos de Processamento (PEs) exatos e aproximados, projetados especificamente para operações de multiplicação de matrizes com sinais (signed) e sem sinal (unsigned).

Células de Produto Parcial Otimizadas:
- PPC (Partial Product Cell): Célula de produto parcial baseada em portas lógicas otimizadas.
- NPPC (Nand-based Partial Product Cell): Célula de produto parcial baseada em portas NAND, projetada para lidar eficientemente com operações de números negativos (sinalizados).
Design Exato:
- Integração de multiplicação e acumulação em um único PE unificado ( $a \times b + c$ ).
- Eliminação da separação convencional entre as etapas, reduzindo atraso e complexidade de hardware.
- Para um PE de 8 bits com sinal, utiliza-se uma combinação de 14 células NPPC e 50 células PPC.
Design Aproximado:
- Substituição das células PPC e NPPC exatas por versões aproximadas.
- Fator de Aproximação ( $k$ ): O design introduz erros controlados onde $k = N - 1$ (para um PE de N bits).
- Lógica de Erro: A célula PPC aproximada introduz 5 saídas errôneas em 16 casos possíveis (taxa de erro de 5/16), enquanto a NPPC é projetada para minimizar o impacto no resultado final.
- A arquitetura permite ajustar o nível de aproximação para equilibrar eficiência e precisão.

3. Contribuições Principais

Arquitetura Híbrida: Proposta de uma arquitetura de SA que suporta tanto PEs exatos quanto aproximados, otimizados para operações com sinal.
Novas Células Lógicas: Desenvolvimento das células PPC e NPPC aproximadas, que alcançam economias de energia de 46,8% e 34,4%, respectivamente, em comparação com o melhor design existente na literatura.
Eficiência em PEs de 8 bits:
- O PE exato de 8 bits com sinal economiza 24,37% de energia em relação ao design de referência [6].
- O PE aproximado de 8 bits com sinal economiza 22,51% de energia em relação ao design [5].
Validação em Aplicações Reais: O design foi validado em três cenários críticos: Transformada Discreta de Cosseno (DCT), detecção de bordas baseada em kernel e detecção de bordas baseada em CNN.

4. Resultados

Os designs foram sintetizados usando a tecnologia UMC de 90 nm e avaliados via Cadence Genus, com simulações de erro em Python.

Desempenho de Hardware (SA 8x8):
- Economia de Energia: O SA exato economiza 16% de energia e o SA aproximado economiza 68% de energia em comparação com designs existentes.
- Produto Potência-Atraso-Área (PADP): O PE aproximado proposto apresenta uma melhoria de até 23% no PADP comparado ao melhor design aproximado existente.
Análise de Erro e Qualidade de Imagem:
- DCT (Compressão de Imagem): Com fator de aproximação $k=2$ , o sistema atingiu um PSNR de 45,97 dB e SSIM de 0,991, indicando qualidade de imagem quase indistinguível da versão exata.
- Detecção de Bordas (Kernel/Laplaciano): Para $k=2$ , alcançou PSNR de 30,45 dB.
- Detecção de Bordas (CNN - BDCN): A integração em uma Rede Neural Convolucional mostrou resultados superiores. Mesmo com alta aproximação, a estrutura da CNN compensa os erros aritméticos, alcançando um PSNR impressionante de 75,98 dB para $k=2$ .
Comparação: O design aproximado proposto supera designs concorrentes ([5], [6], [12]) em termos de economia de energia e área, mantendo métricas de erro (NMED e MRED) competitivas.

5. Significado e Conclusão

Este trabalho demonstra que é possível alcançar ganhos dramáticos na eficiência energética de aceleradores de IA sem sacrificar drasticamente a qualidade da saída em aplicações de visão computacional.

Viabilidade para Edge Computing: A arquitetura é particularmente adequada para dispositivos de borda e IoT, onde a bateria e o espaço são limitados.
Resiliência a Erros: Os resultados validam que a computação aproximada, quando aplicada seletivamente (como nas camadas iniciais de uma CNN ou em operações de DCT), pode ser altamente eficaz.
Equilíbrio: O estudo oferece um equilíbrio promissor entre desempenho, eficiência energética e precisão computacional, estabelecendo um novo padrão para o design de arrays sistólicos em aplicações de processamento de imagem e visão.