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Building reliable 3D photonic integrated circuits and cavities at the wafer scale

该研究通过引入刻蚀辅助化学机械抛光（E-CMP）工艺和新型 $\kappa$ 工程锥形结构，克服了三维光子集成电路在晶圆级扩展中的均匀性与效率 - 尺寸权衡难题，实现了低损耗、高可靠性的三维光子集成及跨层高品质因子光学谐振腔。

原作者： Yuhao Huang, Yunqi Fu, Yu Xia, Yuemin Li, Zheng Li, Yaoran Huang, Zhaoting Geng, Mingfei Liu, Chao Xiang

发布于 2026-04-15

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原作者： Yuhao Huang, Yunqi Fu, Yu Xia, Yuemin Li, Zheng Li, Yaoran Huang, Zhaoting Geng, Mingfei Liu, Chao Xiang

原始论文采用 CC BY 4.0 许可（http://creativecommons.org/licenses/by/4.0/）。 ✨ 这是对下方论文的AI生成解释。它不是由作者撰写或认可的。如需技术准确性，请参阅原始论文。阅读完整免责声明

这篇论文讲述了一个关于如何建造更强大、更可靠、更紧凑的“光子芯片”（也就是用光代替电来传输信息的芯片）的故事。

想象一下，我们现在的电脑芯片（电子芯片）就像是一座座平面的城市。随着城市越来越大，道路（电路）变得非常拥挤，交通堵塞（信号干扰）严重，而且城市只能横向扩张，占地方。

为了解决这个问题，科学家们想出了一个主意：把城市变成摩天大楼（3D 立体结构）。这样，我们可以在同一块地基上建很多层，极大地增加容量。这就是三维光子集成电路（3D PIC）。

但是，要把这个“摩天大楼”在工厂里大规模造出来（晶圆级制造），遇到了两个巨大的拦路虎：

🚧 拦路虎一：上下楼太费劲（层间过渡效率低）

在平面城市里，光沿着路走很顺畅。但在摩天大楼里，光需要从一层“跳”到另一层。

传统方法（像走长坡道）： 以前，为了让光平稳地从一个楼层过渡到另一个楼层，需要造一个非常非常长的“缓坡”（绝热锥形结构）。这就像为了上下楼，必须修一个长达几百米的斜坡，太占地方了！而且，如果斜坡稍微歪一点点，光就掉下去了，效率极低。
新发明（像坐智能电梯）： 作者发明了一种叫 " $\kappa$ -工程化锥形” 的新结构。
- 比喻： 想象一下，以前的斜坡是直上直下的，稍微偏一点就摔。新的设计就像是一个精心设计的“智能电梯”。它不是直上直下，而是根据光的特性，把“电梯井”的形状进行了数学上的完美优化（ $\kappa$ -工程化）。
- 效果： 这个“电梯”不仅短小精悍（省空间），而且非常皮实。就算安装时稍微歪了一点（制造误差），光也能稳稳地传过去。实验证明，它的可靠性比传统方法提高了 75%。

🚧 拦路虎二：楼层高度不平整（晶圆均匀性差）

造摩天大楼时，如果每层楼之间的“楼板”（隔离层）厚度忽高忽低，大楼就会歪，甚至倒塌。

问题： 在芯片制造中，两层光波导之间的二氧化硅（SiO2）隔离层，因为材料应力（像拉紧的橡皮筋）和抛光工艺的问题，往往在晶圆（大圆片）的不同位置厚度不一样。这导致有的地方光能传过去，有的地方传不过去，良品率极低。
新发明（像“先切后磨”的抛光术）： 作者引入了一种叫 E-CMP（刻蚀辅助化学机械抛光） 的技术。
- 比喻： 想象你要把一块凹凸不平的大理石磨平。以前大家只是拼命磨（CMP），但越磨越容易因为内部应力而裂开，或者磨不平。
- 新方法： 作者先像切蛋糕一样，在大理石上切出很多小缝隙（应力释放槽），把内部应力释放掉，防止它乱裂。然后，先用刻蚀刀把高的地方削掉一大块（刻蚀回退），最后再用抛光机轻轻磨平表面。
- 效果： 这样做出来的“楼板”厚度极其均匀，就像用激光水平仪校准过一样。这使得整个晶圆上的芯片性能高度一致，适合大规模量产。

🏆 最终成果：完美的“光子摩天大楼”

通过解决这两个问题，作者成功制造出了：

超低损耗的传输： 光在层与层之间穿梭，损耗极低（相当于光在光纤里跑了几百米才损失一点点能量）。
全新的“空中花园”（3D 高 Q 值光学腔）： 以前，高精密的光学谐振腔（像是一个能存住光的高品质“回音室”）只能建在一层。现在，因为层间传输太完美了，他们可以跨越两层楼来建造这个“回音室”。
- 比喻： 就像以前只能在平地上建一个巨大的体育馆，现在他们可以在两层楼之间建一个悬浮的、跨越楼层的超级体育馆。这为未来的光计算、超灵敏传感器打开了全新的设计空间。

🌟 总结

这篇论文就像是在说：

“我们以前想造光子摩天大楼，但发现楼梯太占地方且容易摔，地板也不平。现在，我们发明了**‘智能电梯’（ $\kappa$ -锥形）和‘先切后磨’的平整术**（E-CMP）。这不仅让大楼建得又高又稳，还让我们能在两层楼之间建造前所未有的超级回音室。这为未来超高速、高密度的光通信和光计算铺平了道路。”

这项技术让 3D 光子芯片从“实验室里的精美模型”变成了“工厂里可以大规模生产的可靠产品”。

这篇论文题为《构建晶圆级可靠的三维光子集成电路和腔体》（Building reliable 3D photonic integrated circuits and cavities at the wafer scale），由香港大学黄宇豪（Yuhao Huang）等人发表。文章针对三维光子集成电路（3D PIC）在晶圆级扩展中面临的均匀性和效率 - 尺寸权衡问题，提出了一套创新的制造工艺和器件设计方案。

以下是该论文的详细技术总结：

1. 研究背景与核心问题

三维光子集成电路（3D PIC）是实现高密度、多功能光子系统的关键方案。然而，将 PIC 从平面扩展到三维结构并实现晶圆级量产，主要受限于两个关键瓶颈：

层间耦合效率与器件尺寸的权衡：传统的绝热锥形波导（Adiabatic Taper）为了实现高耦合效率，需要很长的锥形长度，这严重占用了芯片面积，限制了布局设计的自由度。
晶圆级层间过渡损耗的均匀性：由于晶圆弯曲（Wafer Bow）和氧化层平坦化工艺的不均匀性，导致层间垂直间距（Spacer thickness）在晶圆尺度上存在波动。这种垂直偏差会显著增加层间过渡损耗，且传统结构对横向和纵向对准误差极其敏感，导致良率低下，难以大规模生产。

2. 核心方法论

为了解决上述问题，作者提出了一套结合先进制造工艺和新型器件设计的综合方案：

A. 制造工艺创新：刻蚀辅助化学机械抛光（E-CMP）与应力释放沟槽（SRT）

应力管理：针对氮化硅（SiN）薄膜在高温退火后产生的高张应力导致的晶圆弯曲和薄膜开裂问题，作者引入了应力释放沟槽（SRT）。在每次退火前，将连续的 SiN 薄膜分割成微米级的局部段，从而限制应力传播，有效控制晶圆弯曲。
层间间距均匀性控制：为了解决氧化硅（SiO2）间隔层厚度不均匀的问题，作者开发了**刻蚀辅助化学机械抛光（E-CMP）**工艺。
- 利用纳米压印光刻（NIL）抗蚀剂覆盖台阶，通过电感耦合等离子体（ICP）干法刻蚀进行等比例减薄。
- 随后进行短时 CMP 以获得表面平滑度。
- 该工艺显著降低了台阶高度，实现了晶圆尺度上极高的间隔层厚度均匀性。

B. 器件设计创新： $\kappa$ 工程化锥形波导（ $\kappa$ -engineered Taper）

设计原理：针对传统线性锥形波导（L-taper）在相位匹配点耦合系数（ $\kappa$ ）突变导致效率低、容差差的问题，作者提出了 $\kappa$ 工程化锥形波导。
优化方法：利用埃尔米特插值（Hermite interpolation）对耦合系数曲线进行重塑，使相位匹配点附近的 $\kappa$ 值变化平缓，将原本尖锐的“点”扩展为高效的“面”。
优势：
1. 打破权衡：在更短的物理长度下实现高功率传输，显著减小器件尺寸。
2. 高容差：平缓的功率转移过程使其对横向错位和垂直间距偏差具有极强的鲁棒性。

3. 关键实验结果

研究团队在双层 400nm 厚 SiN 平台上进行了验证，主要数据如下：

工艺均匀性：
- 通过 E-CMP 和 SRT 工艺，实现了极高的晶圆级均匀性。
- 间隔层厚度（B-B 距离）的变异系数（CV）仅为 2.06%，峰度（ $\beta_2$ ）为 2.01，表明分布极其集中且均匀。
- 第一层（L1）和第二层（L2）波导的传播损耗 CV 分别为 11.92% 和 8.99%。
器件性能：
- 传播损耗：L1 和 L2 波导的典型传播损耗分别为 0.077 dB/cm 和 0.068 dB/cm。
- 层间过渡损耗：
  - 传统 L-taper 的过渡损耗约为 8.18 mdB/耦合器，且对边缘晶圆偏差敏感。
  - 新型 $\kappa$ -taper 实现了低至 5.56 mdB/耦合器 的过渡损耗。
  - 在包含 600nm 横向错位和 20µm 短长度的极端条件下， $\kappa$ -taper 仍保持低损耗（0.76 dB），而 L-taper 则完全失效。
- 可靠性指标：定义的可靠性指标 $R$ 显示， $\kappa$ -taper 比传统 L-taper 高出 75%。
3D 高 Q 值腔体：
- 利用超低损耗的层间过渡，成功构建了跨越两个不同器件层的3D 集成高 Q 值光学腔体。
- 该腔体在 S、C、L 通信波段均表现出高 Q 值特性（ $Q_i$ 可达 500 万以上），证明了光波在不同层间传输几乎等同于平面传输。

4. 主要贡献

工艺突破：首次展示了通过 E-CMP 和 SRT 工艺在晶圆尺度上实现 SiN 间隔层的高均匀性控制，解决了 3D PIC 制造中的核心良率问题。
设计突破：提出了 $\kappa$ 工程化锥形波导，从根本上打破了层间耦合效率与器件尺寸之间的传统权衡，并大幅提高了对制造误差（错位、厚度波动）的容忍度。
系统集成：实现了晶圆级可靠的 3D PIC，层间过渡损耗低至 mdB 级别，为构建复杂的多层光子系统奠定了基础。
新应用范式：展示了跨越物理层的高 Q 值 3D 腔体，为异构材料集成（如被动波导、有源元件、非线性介质）提供了无缝的光学连接路径。

5. 意义与展望

这项工作为 3D 光子集成电路从原型走向大规模制造提供了一条标准化的技术路线。

应用前景：该技术可广泛应用于光子互连、计算网络、高密度光子传感器以及非线性光子学领域。
产业价值：通过解决均匀性和可靠性问题，使得高密度、多功能的 3D 光子芯片的大规模量产成为可能，有望推动下一代光子系统的性能突破。

总结而言，该论文通过“工艺优化（E-CMP/SRT）+ 设计创新（ $\kappa$ -taper）”的双轮驱动，成功攻克了 3D PIC 晶圆级制造中的均匀性和效率瓶颈，实现了高性能、高可靠性的三维光子集成。