Transformer Accelerator (TFA): A Macro-Op INT8 Hardware Chip for Transformer Inference and Machine Translation
Este artículo presenta el Acelerador de Transformer (TFA), un motor de hardware INT8 sintetizable que logra una inferencia de transformer de extremo a extremo y con precisión de bits, con una verificación funcional del 100 % y mejoras proyectadas significativas en energía y velocidad respecto a las bases de CPU.
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La inteligencia artificial moderna ha aprendido a hablar, traducir y razonar utilizando un tipo específico de red neuronal llamada transformador. Estos sistemas son increíblemente poderosos, pero también son hambrientos. Para generar una sola palabra nueva en una oración, un transformador debe revisar toda su memoria de hechos aprendidos, un proceso que requiere mover cantidades masivas de datos. Para los dispositivos que funcionan con baterías, como teléfonos inteligentes o sensores, este constante movimiento de información es un cuello de botella. La energía requerida para buscar estos números en la memoria suele superar con creces la energía necesaria para realizar realmente el cálculo con ellos. Esto crea un problema fundamental: ¿cómo construir una máquina que pueda ejecutar estos complejos modelos de lenguaje de manera eficiente en hardware pequeño y de baja potencia sin perder la capacidad de comprender los matices?
Un investigador llamado Shashank ha diseñado un nuevo tipo de chip de hardware específicamente para resolver este problema. En lugar de construir una computadora de propósito general que intente hacer de todo, este chip es una herramienta especializada construida para manejar únicamente la matemática específica requerida para la traducción de idiomas. El diseño, llamado Acelerador de Transformadores, trata al modelo no como un programa para ser interpretado, sino como un flujo de instrucciones que mueve datos directamente desde la memoria hacia un motor de cálculo y de regreso otra vez. El objetivo era crear un dispositivo que pudiera tomar un modelo de lenguaje preentrenado, ejecutarlo íntegramente en silicio y producir resultados que fueran matemáticamente idénticos a la versión original de alta precisión de una computadora, pero utilizando mucha menos energía.
El núcleo de este trabajo es un chip que opera utilizando números enteros en lugar de las complejas fracciones decimales que se utilizan típicamente en la computación científica. Al cambiar a estos números enteros más simples, la cantidad de datos que deben moverse se reduce drásticamente. Sin embargo, este cambio suele causar una pérdida de precisión porque las pequeñas diferencias en los números se redondean. El investigador descubrió que la forma estándar de redondear estos números fallaba para este tipo específico de modelo de lenguaje, haciendo que la traducción se volviera ininteligible. La solución no fue cambiar el chip, sino cambiar cómo se preparaba el modelo antes de ser cargado en el hardware. Al aplicar una rotación matemática precisa a los pesos internos del modelo durante la fase de preparación, el investigador suavizó los números difíciles. Esto permitió que el chip simple y de baja potencia produjera resultados bit por bit idénticos al original complejo, ocultando efectivamente la dificultad de la matemática dentro del software en lugar de en el hardware.
Para demostrar que esto funcionaba, el investigador tomó un modelo de traducción completo y preentrenado capaz de convertir inglés en francés, alemán y rumano, y lo compiló en una serie de instrucciones para el chip. Luego, el chip fue sometido a una simulación rigurosa que verificó cada paso del proceso. Los resultados mostraron que el chip podía ejecutar todo el flujo de traducción, incluyendo los complejos mecanismos de atención que permiten al modelo enfocarse en las palabras correctas, con cero errores. Cuando el chip generó traducciones para diez proverbios difíciles en inglés, coincidió perfectamente con la salida de la computadora original en términos de los datos subyacentes. En la mitad de los casos, las palabras traducidas finales fueron idénticas a la referencia de punto flotante; en la otra mitad, el chip produjo traducciones diferentes pero igualmente válidas, como usar una palabra distinta para el mismo concepto o un signo de puntuación diferente. Esto demostró que el hardware no solo era rápido, sino confiable.
Las ganancias de rendimiento fueron sustanciales. En comparación con un procesador de computadora estándar de veintidós hilos, el diseño del chip fue capaz de generar tokens veinte veces más rápido en su configuración más pequeña, incluso cuando se ejecutaba en un sistema de memoria simulado que era intencionalmente lento y difícil. Los investigadores proyectaron que versiones más grandes de este chip podrían ser casi doscientas veces más rápidas que la computadora de referencia. Más importante aún, la eficiencia energética fue asombrosa. Se estimó que el chip usaría aproximadamente tres mil veces menos energía por palabra generada que el procesador de la computadora. Esta eficiencia proviene de la capacidad del chip para transmitir los pesos a través de sus unidades de cálculo a la velocidad máxima que permite la memoria, en lugar de esperar a que el cálculo termine antes de buscar la siguiente pieza de datos.
El trabajo no se detuvo en la simulación. Para asegurar que el diseño no fuera solo un ejercicio teórico, el investigador tomó la descripción digital del chip y la procesó a través de un flujo de fabricación completo utilizado para la creación de silicio real. Este proceso convirtió el diseño en un diseño físico que podía imprimirse en un chip. El diseño resultante pasó todas las reglas estrictas requeridas para la fabricación, confirmando que el diseño era físicamente realizable. Aunque la versión específica probada fue construida utilizando tecnología de fabricación más antigua y grande, el diseño físico exitoso demostró que la arquitectura es sólida y podría reducirse a procesos modernos de alta velocidad. Se espera que el chip físico, una vez construido con componentes de memoria avanzados, sea aún más pequeño y rápido.
Este proyecto destaca un cambio en cómo podríamos construir el futuro de la inteligencia artificial. En lugar de intentar hacer que las computadoras de propósito general sean más rápidas, el enfoque se centra en construir pequeños motores especializados que hagan una sola cosa perfectamente. Al separar la matemática difícil de manejar números imprecisos hacia la etapa de preparación del software, el hardware mismo puede permanecer simple, rápido e increíblemente eficiente. El éxito de este diseño sugiere que podemos ejecutar modelos de lenguaje sofisticados en el borde, en dispositivos que actualmente son demasiado pequeños para manejarlos, sin sacrificar la precisión que hace que estos modelos sean útiles. El camino a seguir implica escalar este diseño para manejar modelos más grandes y tareas lingüísticas más complejas, pero la base ha sido establecida: un chip pequeño, verificado y fabricable que puede traducir los idiomas del mundo con la precisión de una supercomputadora y la eficiencia de un dispositivo alimentado por batería.
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