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TinyML-CoDE: A Co-Design and Evaluation Framework for Systematic TinyML Development

Este artículo propone TinyML-CoDE, un marco integral de codiseño y evaluación que aborda cinco brechas de investigación críticas en el desarrollo de TinyML con recursos limitados mediante la integración de benchmarking estandarizado, codiseño de hardware-software, gestión del ciclo de vida, seguridad e interoperabilidad de la cadena de herramientas para permitir despliegues de inteligencia en el borde escalables y reproducibles.

Autores originales: Dhananjaya Lahiru Bandara, Charith Jayathilake, Mohamed Munawwer Mohamed Mirshad

Publicado 2026-11-05

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CC BY 4.0

Autores originales: Dhananjaya Lahiru Bandara, Charith Jayathilake, Mohamed Munawwer Mohamed Mirshad

Artículo original bajo licencia CC BY 4.0 (https://creativecommons.org/licenses/by/4.0/). ✨ Esta es una explicación generada por IA del artículo a continuación. No ha sido escrita ni avalada por los autores. Para mayor precisión técnica, consulte el artículo original. Leer descargo de responsabilidad completo

Imagina un mundo donde los dispositivos que nos rodean —el termostato en la pared, el sensor en una máquina de fábrica, el reloj en la muñeca— puedan pensar por sí mismos. Pueden reconocer un comando de voz, detectar un defecto en una viga de metal o detectar una irregularidad cardíaca sin necesidad de enviar datos a un servidor remoto en la nube. Esta visión se apoya en un campo de la tecnología llamado Tiny Machine Learning (Aprendizaje Automático Diminuto), donde complejos programas informáticos se reducen para caber dentro de los chips de computadora más pequeños, baratos y con mayor consumo de energía disponibles. Estos chips, que a menudo se encuentran en aparatos cotidianos, tienen muy poca memoria y funcionan con baterías diminutas. La promesa es que la inteligencia pueda existir en todas partes, incluso en lugares donde las conexiones a internet son débiles o inexistentes. Sin embargo, la construcción de estos sistemas ha sido un proceso caótico. Los desarrolladores suelen luchar para que sus programas funcionen en hardware específico, perdiendo tiempo en ensayos y errores, mientras que los resultados que publican son difíciles de comparar porque cada uno mide el éxito de manera diferente.

Un equipo de investigadores de la Universidad de Staffordshire, en el Reino Unido, ha propuesto una nueva forma de organizar este trabajo, con el objetivo de traer orden al caos. Analizaron docenas de estudios recientes para identificar exactamente dónde están fallando los métodos actuales. Encontraron que el campo sufre cinco problemas principales. Primero, no existe una forma estandarizada de medir qué tan bien funciona un sistema; algunos investigadores informan solo qué tan preciso es un programa, mientras ignoran cuánto consume de batería o cuánto tiempo tarda en tomar una decisión. Segundo, el proceso de elegir el chip de computadora adecuado y el modelo de software adecuado se realiza por separado, lo que genera coincidencias deficientes donde un sistema es demasiado pesado para su chip o demasiado débil para su tarea. Tercero, una vez instalado un dispositivo, hay poco soporte para gestionarlo a lo largo del tiempo, como actualizar su software o notar cuando comienza a fallar. Cuarto, la seguridad suele ser algo secundario, dejando a estos pequeños dispositivos vulnerables. Finalmente, las herramientas utilizadas para construir estos sistemas no se comunican entre sí, lo que obliga a los desarrolladores a empezar desde cero cuando cambian de un tipo de chip a otro.

Para resolver estos problemas, los investigadores diseñaron un marco integral que llaman TinyML-CoDE. Este no es un único software, sino un flujo de trabajo estructurado que guía a un desarrollador desde el inicio de un proyecto hasta su mantenimiento a largo plazo. El proceso comienza definiendo claramente las reglas del juego: cuánta memoria hay disponible, cuánta batería se puede usar y qué tan rápido debe responder el dispositivo. Basándose en estos límites estrictos, el marco sugiere la mejor combinación de hardware y software. Luego, aplica automáticamente técnicas para encoger y acelerar el modelo informático, asegurando que quepa dentro de los límites definidos sin perder demasiada precisión. Una vez construido el sistema, el marco proporciona un conjunto estándar de pruebas para medir su rendimiento de manera justa, registrando no solo la precisión, sino también el uso de energía y la velocidad. Finalmente, incluye herramientas para gestionar el dispositivo después de su despliegue, permitiendo actualizaciones seguras y el monitoreo de su salud a lo largo del tiempo.

Los investigadores probaron la lógica de su marco utilizando simulaciones y prototipos preliminares en lugar de un despliegue a gran escala en miles de dispositivos. Su análisis sugiere que utilizar este enfoque sistemático podría reducir el tiempo necesario para desarrollar un nuevo sistema en un 30 por ciento. Estiman que podría mejorar la eficiencia energética en un 25 por ciento, lo que significa que los dispositivos durarían más con una sola carga de batería. Además, proyectan que la tasa de despliegues exitosos a la primera podría aumentar en un 20 por ciento, reduciendo el número de proyectos fallidos que actualmente plagan la industria. El equipo planea lanzar las herramientas como software de código abierto, permitiendo que cualquiera las use y las mejore, y han delineado una hoja de ruta de dos años para construir y probar cada parte del sistema. Al convertir un proceso fragmentado y difícil en un camino claro y repetible, este trabajo pretende hacer que los dispositivos inteligentes y autosuficientes sean una realidad confiable para industrias que van desde la atención médica hasta el monitoreo ambiental.

Resumen Técnico: TinyML-CoDE – Un Marco de Co-Diseño y Evaluación para el Desarrollo Sistemático de TinyML

1. Declaración del Problema

La proliferación de Tiny Machine Learning (TinyML) en dispositivos de Internet de las Cosas (IoT) con recursos limitados promete una inteligencia de borde ubicua. Sin embargo, las prácticas de desarrollo actuales se caracterizan por ser ad hoc, fragmentadas y difíciles de escalar. Los desarrolladores se enfrentan a un "mosaico" de cadenas de herramientas específicas de proveedores, requisitos de optimización manual y marcos incompatibles (por ejemplo, TensorFlow Lite Micro, CMSIS-NN, Edge Impulse) a través de diversas arquitecturas de hardware (desde MCUs de 8 bits hasta RISC-V con NPUs).

El artículo identifica cinco puntos críticos persistentes resultantes de esta fragmentación:

Resultados Incomparables: Los investigadores suelen reportar ganancias de precisión omitiendo métricas críticas como la energía y la latencia.
Selección de Hardware Subóptima: Los modelos se aprovisionan con exceso o defecto debido a la falta de un co-diseño sistemático entre hardware y software.
Negligencia Post-Despliegue: Los flujos de trabajo existentes carecen de herramientas para la gestión del ciclo de vida, incluyendo actualizaciones, detección de deriva y retiro.
Seguridad como Consideración Secundaria: El gasto computacional criptográfico suele ignorarse, dejando los dispositivos vulnerables.
Bloqueo por Cadena de Herramientas (Toolchain Lock-in): Migrar modelos entre marcos de trabajo a menudo requiere reescribir o re-optimizar, lo que conduce a un esfuerzo desperdiciado.

Una revisión sistemática de 35 artículos revisados por pares (2020–2025) reveló que el 85% depende de benchmarks públicos sintéticos, solo el 15% reporta mediciones completas de energía y solo el 22% proporciona suficiente detalle para la reproducibilidad.

2. Metodología

Los autores emplean una metodología de Investigación de Ciencia del Diseño (DSR), estructurada en tres ciclos:

Ciclo de Relevancia: Estableció el contexto del problema mediante una revisión sistemática de la literatura (siguiendo las directrices PRISMA) y entrevistas con profesionales.
Ciclo de Diseño: Desarrollo iterativo del marco guiado por cinco principios de diseño destilados: abstracción con especificidad, optimización sensible a las restricciones, interoperabilidad por diseño, seguridad integrada y validación empírica.
Ciclo de Rigor: Validación mediante prototipado por componentes y casos de estudio planificados.

La investigación se fundamenta en una revisión sistemática de 35 artículos seleccionados de un grupo inicial de 120, centrándose en plataformas de hardware, marcos de trabajo, métodos de optimización y métricas de evaluación.

3. Contribuciones Clave

El artículo propone TinyML-CoDE, un marco de Co-Diseño y Evaluación diseñado para integrar la especificación consciente de las restricciones, la recomendación de hardware-modelo, la optimización automatizada, el benchmarking unificado y la gestión del ciclo de vida en un flujo de trabajo coherente.

Los Cinco Componentes Integrados:

Especificación Consciente de Restricciones: Traduce requisitos informales en un perfil legible por máquina ( $C$ ) que define la precisión mínima ( $A_{min}$ ), latencia máxima ( $L_{max}$ ), memoria ( $M_{max}$ ), energía ( $E_{max}$ ), costo ( $C_{max}$ ) y necesidades de comunicación.
Recomendación de Hardware-Modelo: Un algoritmo que genera una lista clasificada de pares (hardware, modelo) a partir de un repositorio pre-calculado, satisfaciendo las restricciones estrictas y optimizando una función objetivo ponderada.
Optimización Automatizada: Un pipeline adaptativo que aplica pasadas de optimización (cuantización, poda, fusión de operadores, optimización de kernels) basadas en el perfil de restricción específico. Un bucle de retroalimentación asegura que no se violen las restricciones.
Suite de Benchmarking Unificado (TinyML-Bench): Un marco de evaluación estandarizado que mide precisión, latencia (media y percentil 95), memoria (pico y promedio) y energía por inferencia. Incluye cargas de trabajo fijas, protocolos de medición y manifiestos de reproducibilidad.
Gestión del Ciclo de Vida: Soporta control de versiones, monitoreo de rendimiento en el dispositivo, actualizaciones Over-the-Air (OTA) mediante compresión diferencial y firma Ed25519, detección de deriva mediante control estadístico de procesos y retiro seguro del sistema.

Brechas de Investigación Abordadas:

El marco aborda específicamente cinco brechas de investigación identificadas (G1–G5):

G1: Benchmarking estandarizado entre precisión, latencia, memoria y energía.
G2: Co-diseño sistemático de hardware-software.
G3: Gestión del ciclo de vida más allá del despliegue inicial.
G4: Integración de seguridad para dispositivos con recursos limitados.
G5: Interoperabilidad de la cadena de herramientas para evitar el bloqueo del proveedor.

4. Resultados y Proyecciones

Dado que este es un artículo metodológico que propone un marco de trabajo, los resultados presentados son proyecciones analíticas y validaciones preliminares de prototipos de componentes, más que resultados de despliegue empírico a gran escala.

Basándose en el modelado analítico y prototipos tempranos, los autores proyectan las siguientes mejoras sobre un enfoque base "sin marco de trabajo":

Tiempo de Desarrollo: Una reducción del 30% (de 40 horas a 28 horas por modelo).
Eficiencia Energética: Una mejora del 25% (reducción de µJ por inferencia).
Tasa de Éxito de Despliegue: Un aumento del 20% en el porcentaje de modelos que cumplen con todas las restricciones en el primer intento (del 60% al 80%).
Reproducibilidad: Un aumento proyectado de 40 puntos en una puntuación de reproducibilidad de 0 a 100.
Huella de Memoria: Una reducción proyectada del 15%.

El artículo describe una hoja de ruta de implementación de 24 meses, que incluye el desarrollo de la suite de benchmarking, la integración con los backends de TFLM y CMSIS-NN, y la validación mediante casos de estudio industriales (mantenimiento predictivo) y de salud (ECG).

5. Significación

La importancia de TinyML-CoDE radica en su intento de eliminar la fragmentación actual en el desarrollo de TinyML. Al proporcionar una vía sistemática desde los requisitos de la aplicación hasta sistemas monitoreados y mantenidos, el marco pretende:

Permitir despliegues de TinyML escalables, reproducibles y mantenibles.
Facilitar la comparación justa de soluciones mediante un benchmarking estandarizado.
Reducir el tiempo de llegada al mercado para desarrolladores industriales mediante la automatización de la selección de hardware y la optimización.
Integrar la seguridad y la gestión del ciclo de vida como componentes centrales en lugar de consideraciones secundarias.

Los autores enfatizan que el marco está diseñado para ser interoperable con las herramientas existentes (por ejemplo, TensorFlow Lite Micro, CMSIS-NN) en lugar de reemplazarlas, con el objetivo de reducir la barrera de adopción tanto para investigadores como para profesionales de la industria. El trabajo futuro incluye el lanzamiento de código abierto de la suite de benchmarking, experimentos controlados con desarrolladores y la extensión del marco para soportar técnicas de preservación de la privacidad como el aprendizaje federado.