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High-fidelity and robust controlled-Z gates for superconducting transmon qubits. I. Intrinsic errors and decoherence

Questo articolo presenta un quadro completo di controllo ottimo per qubit transmon superconduttori che realizza gate controlled-Z ad alta fedeltà da 12 ns con errori intrinseci soppressi a $2\times10^{-5}$ , tenendo conto sistematicamente dei meccanismi di decoerenza e identificando punti di dolcezza del dephasing per migliorare la robustezza al rumore.

Autori originali: Chia-Hsien Huang, Hsi-Sheng Goan

Pubblicato 2026-10-22

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CC BY 4.0

Autori originali: Chia-Hsien Huang, Hsi-Sheng Goan

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La ricerca di una macchina in grado di risolvere problemi oltre la portata dei computer odierni si basa su una fragile fondamenta: il bit quantistico, o qubit. A differenza degli interruttori stabili di un computer standard, queste unità quantistiche esistono in uno stato delicato di probabilità, facilmente frantumabile dal minimo tocco del loro ambiente. Per eseguire calcoli utili, gli scienziati devono manipolare questi qubit con estrema precisione, facendoli passare da uno stato all'altro utilizzando porte che agiscono come interruttori logici. Tuttavia, questi interruttori sono soggetti a due tipi principali di fallimento. In primo luogo, le leggi fisiche che governano i qubit stessi possono causare la loro deriva o la perdita di energia, creando errori anche in un vuoto perfetto. In secondo luogo, il mondo reale è rumoroso; le fluttuazioni di temperatura e le interferenze elettriche bombardano costantemente il sistema, confondendo le informazioni prima che il calcolo sia terminato. Mentre i ricercatori tentano di scalare questi sistemi da un manipolo di qubit ai migliaia necessari per un uso pratico, la necessità di porte che non siano solo veloci e accurate, ma anche ostinatamente resistenti a questo rumore, diventa critica. Se ogni porta richiede un controllo e una ricalibrazione costante, la macchina passerà più tempo a riparare se stessa che a risolvere problemi.

In uno studio recente, i ricercatori hanno sviluppato una strategia completa per costruire queste porte resilienti per i qubit transmon superconduttori, un tipo di hardware quantistico leader. Il team si è concentrato sulla porta controlled-Z, un'operazione fondamentale a due qubit, e ha cercato di progettare un segnale di controllo che potesse eseguire la porta in tempi record pur sopprimendo simultaneamente gli errori interni del sistema e il rumore esterno che lo affligge. Trattando la progettazione del segnale di controllo come un complesso problema di ottimizzazione, hanno ingegnerizzato una specifica sequenza di impulsi di flusso magnetico che guidano i qubit durante la loro operazione. Questa sequenza è divisa in due parti: una fase di "pull-back" che sposta rapidamente i qubit verso un punto operativo favorevole, e una fase di "fine-tuning" che effettua sottili regolazioni per sincronizzare il loro comportamento e cancellare gli errori. Il risultato è una porta che opera in soli 12 nanosecondi, una durata così breve che è quasi pari al limite di velocità teorico per questo tipo di hardware.

I ricercatori hanno scoperto che, modellando attentamente questi impulsi, potevano sopprimere gli errori intrinseci della porta a un livello di 2 su 100.000. Questo è un traguardo straordinario perché significa che la porta è quasi perfetta ancora prima di tenere conto della disordinata realtà dell'ambiente di laboratorio. Per affrontare questa realtà, il team ha costruito modelli dettagliati delle sorgenti di rumore, distinguendo tra i rapidi e casuali tremolii dell'elettronica a temperatura ambiente e il rumore lento e errante che segue un modello specifico noto come rumore 1/f. Hanno scoperto che i qubit hanno dei "punti dolci" (sweet spots): frequenze operative specifiche dove sono naturalmente meno sensibili a queste perturbazioni. Guidando i qubit verso questi punti dolci durante l'operazione della porta, il team ha potuto ridurre drasticamente l'impatto del rumore.

Una scoperta chiave in questo lavoro è il ruolo dell'asimmetria nella progettazione stessa dei qubit. I ricercatori hanno dimostrato che, rendendo intenzionalmente le due giunzioni all'interno di un qubit transmon leggermente diverse in dimensioni, potevano sintonizzare il sistema per essere robusto contro diversi tipi di rumore. Ad esempio, un certo grado di asimmetria ha permesso alla porta di mantenere un'alta accuratezza anche quando il rumore veloce proveniente dall'elettronica era aumentato di sette volte o il rumore di deriva lenta era quadruplicato. Altre configurazioni offrivano una protezione ancora maggiore: un design poteva resistere a un aumento di cento volte del rumore lento, mentre un altro poteva gestire un aumento di dieci volte del rumore veloce. Questa flessibilità suggerisce che gli ingegneri possono ora personalizzare le proprietà fisiche dei loro qubit per adattarli allo specifico ambiente di rumore del loro laboratorio, invece di combattere una battaglia persa contro un background generico.

Lo studio ha anche affrontato un ostacolo pratico spesso trascurato nelle progettazioni teoriche: i limiti dell'attrezzatura utilizzata per generare i segnali di controllo. Le macchine che creano questi impulsi precisi hanno una larghezza di banda finita, che può distorcere le forme d'onda ideali e rovinare le prestazioni della porta. I ricercatori hanno sviluppato un metodo per "affinare" i loro impulsi ottimizzati per tenere conto di queste distorsioni, recuperando efficacementamente le prestazioni ad alta fedeltà anche quando utilizzano apparecchiature commerciali standard. Quando hanno applicato il loro miglior design a un sistema con l'asimmetria ottimale, il tasso di errore totale è sceso a meno di 5 su 10.000. Sebbene gli errori rimanenti fossero dovuti principalmente alla naturale perdita di energia dei qubit, il team ha osservato che, con futuri miglioramenti nei materiali che possano estendere la durata di vita del qubit, il tasso di errore potrebbe potenzialmente scendere al di sotto della soglia richiesta per il calcolo quantistico fault-tolerant.

Questo lavoro stabilisce un quadro unificato che bilancia velocità, accuratezza e robustezza, offrendo una chiara via d'uscita per scalare i processori quantistici. Combinando operazioni di porta rapide con design resistenti al rumore e tecniche di calibrazione pratiche, i ricercatori hanno dimostrato che è possibile costruire porte che rimangano affidabili nonostante le inevitabili variazioni e fluttuazioni presenti in hardware su larga scala. Le scoperte forniscono una tabella di marcia per ridurre la necessità di una ricalibrazione costante, un importante collo di bottiglia negli attuali sistemi quantistici, e suggeriscono che la strada verso un computer quantistico funzionale e su larga scala possa essere pavimentata con porte che non sono solo veloci, ma fondamentalmente resistenti.

Sintesi Tecnica: Gate CZ ad alta fedeltà e robusti per qubit transmon superconduttori. I. Errori intrinseci e decoerenza

Problematica
L'informatica quantistica fault-tolerant richiede gate quantistici che raggiungano simultaneamente una breve durata, un'alta fedeltà e la robustezza al rumore. Man mano che i processori quantistici scalano, la caratterizzazione esaustiva e la ricalibrazione frequente dei singoli gate diventano impraticabili, creando un collo di bottiglia operativo. Sebbene i qubit transmon superconduttori abbiano dimostrato gate controlled-Z (CZ) a due qubit ad alta fedeltà, ulteriori miglioramenti richiedono una comprensione completa dell'interazione tra errori hamiltoniani intrinseci, meccanismi di decoerenza realistici (rilassamento dell'energia e dephasing) e incertezze sistematiche dei parametri. Le sfide attuali includono lo sviluppo di framework di controllo che tengano conto di molteplici fonti di errore sotto vincoli sperimentali realistici (come i limiti di larghezza di banda dei generatori di forme d'onda arbitraria - AWG) mantenendo al contempo la robustezza contro le fluttuazioni del rumore e le variazioni dei dispositivi.

Metodologia
Gli autori sviluppano un framework di controllo ottimale unificato per qubit transmon direttamente accoppiati e a frequenza sintonizzabile. La metodologia integra i seguenti componenti:

Framework di Controllo Ottimale Unificato: L'infedeltà totale del gate è decomposta in una somma modulare di contributi da errori intrinseci, rilassamento dell'energia e dephasing. Ciò consente di adattare la funzione di costo ai meccanismi di errore dominanti ed estenderla per includere ulteriori fonti.
Progettazione di Impulsi Physics-Informed: L'impulso di flusso di controllo $\Phi(t)$ è costruito come la somma di un "Pull-Back-Pulse" ( $\Phi_{PBP}$ ) e di un "Fine-Tune-Pulse" ( $\Phi_{FTP}$ ). $\Phi_{PBP}$ guida rapidamente il sistema verso un punto operativo favorevole (sweet spot) e lo mantiene, mentre $\Phi_{FTP}$ fornisce una modulazione locale per minimizzare la funzione di costo. Questa struttura garantisce transizioni fluide e facilita una convergenza efficiente.
Decomposizione Gerarchica degli Errori: Gli errori intrinseci sono decomposti numericamente in contributi di fase, swap e leakage. Il leakage è ulteriormente risolto in percorsi a quanta dispari e pari (Qt-2 a Qt-6), e gli errori di swap sono separati in rotazioni dello spazio computazionale. Questa gerarchia guida l'allocazione delle risorse di simulazione.
Modellazione del Rumore Realistica: I modelli di rumore sono calibrati rispetto alle misure sperimentali di coerenza Ramsey pubblicate e ai budget di errore del gate CZ. Questi modelli catturano il dephasing veloce (rumore bianco proveniente dall'elettronica di controllo a temperatura ambiente) e il dephasing lento (rumore di flusso $1/f$ ). I modelli sono validati riproducendo la dipendenza sperimentale della frequenza del qubit dai tempi di dephasing $T_{\phi,1}$ e $T_{\phi,2}$ .
Fine-Tuning Consapevole del Filtraggio AWG: Una procedura di post-ottimizzazione incorpora un modello di filtraggio AWG sperimentalmente rilevante (filtro Gaussiano) per tenere conto delle distorsioni della forma d'onda causate dalla larghezza di banda finita, recuperando le prestazioni del gate nelle implementazioni pratiche.
Identificazione dello Sweet Spot e Sfruttamento dell'Asimmetria: Il framework identifica gli "sweet spot di dephasing" dove la sensibilità al rumore è minimizzata. Esplora sistematicamente l'asimmetria dei transmon (quantificata dal rapporto dell'energia di Josephson $a_{EJ} = E_{J1}/E_{J2}$ ) come parametro di design per accedere a distinti regimi operativi resistenti al rumore.

Contributi Chiave

Framework Unificato: Integrazione della dinamica Hamiltoniana intrinseca e dei modelli di decoerenza calibrati in un singolo processo di progettazione del gate per l'ottimizzazione simultanea di fedeltà e robustezza.
Ingegneria degli Impulsi: Proposta di una specifica decomposizione dell'impulso ( $\Phi_{PBP} + \Phi_{FTP}$ ) che stabilisce un punto di partenza favorevole per l'ottimizzazione, consentendo la soppressione degli errori dominanti.
Analisi Dettagliata degli Errori: Decomposizione numerica degli errori intrinseci (fase, swap, leakage) che identifica i meccanismi dominanti e guida gli obiettivi di ottimizzazione.
Gestione dei Vincoli Sperimentali: Sviluppo di una procedura di fine-tuning che recupera la fedeltà del gate nonostante i limiti di larghezza di banda dell'AWG (es. cutoff a 424,7 MHz).
Modellazione del Rumore: Costruzione di modelli di rumore realistici per il dephasing veloce e lento, calibrati rispetto ai dati sperimentali, che consentono la previsione quantitativa delle prestazioni del gate.
Strategie di Sweet-Spot e Asimmetria: Identificazione sistematica degli sweet spot sia per il dephasing veloce che per quello lento. Il documento dimostra che l'asimmetria del transmon ( $a_{EJ}$ ) può essere sintonizzata per bilanciare la robustezza contro diversi tipi di rumore: i transmon fortemente asimmetrici ( $a_{EJ} \approx 11,0$ ) sopprimono la sensibilità al rumore di flusso, mentre i transmon debolmente asimmetrici ( $a_{EJ} \approx 1,1$ ) sopprimono la sensibilità al dephasing veloce.
Quantificazione della Robustezza: Quantificazione dei margini di tolleranza, mostrando che i gate ottimizzati possono mantenere l'infedeltà al di sotto di $10^{-3}$ nonostante aumenti significativi della forza del rumore (fino a 90 $\times$ per il dephasing lento nei transmon fortemente asimmetrici e 10 $\times$ per il dephasing veloce nei transmon debolmente asimmetrici).

Risultati

Velocità del Gate ed Errore Intrinseco: Utilizzando impulsi di flusso fluidi a colpo singolo, gli autori ottengono gate CZ da 12 ns, vicini al limite teorico di velocità di 11,6 ns. Gli errori intrinseci sono soppressi al livello di $2 \times 10^{-5}$ .
Asimmetria Ottimale: Per i transmon con un'asimmetria ottimale di $a_{EJ} = 1,31$ , operando vicino allo sweet spot congiunto di dephasing veloce e lento, si ottiene un'infedeltà totale del gate di $4,66 \times 10^{-4}$ . Questa è prevalentemente limitata dal rilassamento dell'energia ( $4 \times 10^{-4}$ per $T_1 = 30$ $\mu$ s), con errori intrinseci a $2,46 \times 10^{-5}$ e dephasing totale a $4,11 \times 10^{-5}$ .
Prestazioni Proiettate: Con tempi di coerenza allo stato dell'arte ( $T_1 = 360$ $\mu$ s, raggiungibili con il tantalio), l'infedeltà totale proiettata scende a $9,90 \times 10^{-5}$ . Se il rumore dell'elettronica di controllo a temperatura ambiente viene eliminato, l'uso di transmon fortemente asimmetrici ( $a_{EJ} = 11,0$ ) produce un'infedeltà totale di $5,22 \times 10^{-5}$ .
Robustezza: Il gate ottimizzato mantiene un'infedeltà inferiore a $10^{-3}$ anche quando la forza del rumore di dephasing veloce è aumentata di sette volte o la forza del rumore di dephasing lento è aumentata di quattro volte rispetto ai livelli caratterizzati sperimentalmente.
Recupero del Filtraggio: Per un AWG commerciale con un cutoff di 424,7 MHz, l'effetto di filtraggio aumenta inizialmente l'infedeltà intrinseca a $1,14 \times 10^{-2}$ . La procedura di fine-tuning proposta riduce questo valore a $2,05 \times 10^{-5}$ , ripristinando efficacementamente le prestazioni originali.

Significatività e Rivendicazioni
Il documento afferma di aver stabilito un framework applicabile sperimentalmente per bilanciare velocità del gate, fedeltà e robustezza al rumore. Riducendo la necessità di una caratterizzazione precisa e di ricalibrazioni frequenti, questo approccio affronta un crescente collo di bottiglia operativo per l'hardware quantistico su larga scala. I risultati dimostrano che l'asimmetria del transmon funge da parametro di design sintonizzabile per adattare la robustezza del gate a specifici ambienti di rumore. Gli autori asseriscono che il loro framework fornisce una base per estendere questi principi ad architetture di accoppiamento più complesse (es. accoppiatori sintonizzabili, accoppiamento mediato da risonatori) e che la combinazione di operatività vicino al limite di velocità, infedeltà sub- $10^{-3}$ e tolleranza al rumore di ordini di grandezza offre una via verso l'implementazione di gate robusti nell'attuale hardware superconduttore e in quello prossimo. Il documento nota esplicitamente che, sebbene affronti la decoerenza e gli errori intrinseci, la rimanente sfida critica per il fault tolerance — ovvero la robustezza contro le incertezze sistematiche dei parametri — è trattata in un articolo complementare (Parte II).

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