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PackSELL: A Sparse Matrix Format for Precision-Agnostic High-Performance SpMV

本論文は、デルタ符号化と新しいパッキング方式を採用してメモリ効率とデータ転送を最適化し、GPU 上の疎行列 - ベクトル乗算（SpMV）および混合精度反復解法において、既存の cuSPARSE 実装を大幅に上回る性能を実現する新しい疎行列フォーマット「PackSELL」を提案しています。

原著者： Kengo Suzuki, Takeshi Iwashita

公開日 2026-04-16

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CC BY 4.0

原著者： Kengo Suzuki, Takeshi Iwashita

原論文は CC BY 4.0 (http://creativecommons.org/licenses/by/4.0/) でライセンスされています。 ✨ これは以下の論文のAI生成解説です。著者が執筆または承認したものではありません。技術的な正確性については原論文を参照してください。免責事項の全文を読む

📦 1. 問題：倉庫（メモリ）が混雑している！

現代のコンピューター（特に GPU）は、計算速度が非常に速いですが、**「データを運ぶ速度（メモリ帯域）」が追いついていません。
これは、「トラック（計算機）が速く走れるのに、道路（メモリ）が狭くて渋滞している」**ような状態です。

特に、科学計算などで使われる**「疎行列（スパース行列）」というデータは、「0（何もない場所）」がほとんどで、数字（値）がまばらに散らばっているという特徴があります。
従来のやり方では、この「0」の場所まで全部記録してしまったり、数字と場所の情報をバラバラに管理していたため、「無駄な荷物（0 や余計な情報）」を大量に運んでしまい、渋滞がひどくなっていた**のです。

🚀 2. 解決策：PackSELL（パックセル）の登場

そこで研究者たちは、**「PackSELL」**という新しい詰め方ルールを考え出しました。これは、従来の「SELL」というルールをさらに進化させたものです。

🧩 核心となるアイデア：2 つの魔法

PackSELL は、2 つの魔法を使って荷物を劇的に減らします。

① 「相対位置」で場所を記録する（デルタ符号化）

従来の方法： 「3 番目の棚」「10 番目の棚」「15 番目の棚」と、絶対的な場所を全部書き記す。
PackSELL の方法： 「3 番目」の次は「+7（3 から 7 進んだ場所）」、「その次は**+5**」と、**「前からの距離」**だけを書き記す。
- 例え： 「東京駅」から「新宿駅」まで行く時、「東京から 50km 先」「東京から 55km 先」と書くのではなく、「新宿は東京から 50km、次の駅はそこから 5km 先」と書く方が、数字が小さくて済みますよね？
- これにより、場所を表す数字が小さくなり、メモリの節約になります。

② 「場所」と「中身」を 1 つの箱に詰め込む（パッキング）

従来の方法： 「場所リスト」と「中身リスト」を別々の箱に入れて運ぶ。
PackSELL の方法： 「場所（距離）」と「中身（数字）」を1 つの箱（1 つの言葉）にぎゅっと詰め込む。
- 例え： 従来のやり方は、「住所のメモ」と「商品」を別々の袋に入れて運んでいる状態。PackSELL は、「住所が書かれたラベルを商品に直接貼り付けて、1 つの袋にしまう」ようなものです。
- さらに、この箱のサイズ（ビット数）を自由に調整できます。「場所のメモ」を小さくして、「中身」を大きくしたり、その逆も可能です。

🎨 3. すごいところ：「自由な形」の箱が作れる

これが一番の画期的な点です。

従来のルール： 箱のサイズは決まっていて（例えば 32 ビットや 16 ビット）、それに合わせるために、無駄なスペース（パディング）を埋めなければなりませんでした。
PackSELL のルール： 「場所」と「中身」の割合を自由にいじれるので、**「0.5 倍の箱」や「変な形の箱」**も作れます。
- 例えば、**「FP16（半精度）」**という、数字の精度を少し落としてでも速度を重視するモードで使えば、従来の 1.6 倍も速く計算できました。
- さらに、**「IEEE 754（標準の浮動小数点）」という決まりに縛られない、「独自の数字のルール（非 IEEE 形式）」も作れます。これにより、「精度は FP32（標準）並みなのに、速度は FP16（高速）並み」という「夢のようなバランス」**を実現しました。

🏁 4. 結果：どんなメリットがある？

この PackSELL を使った実験では、以下のような素晴らしい結果が出ました。

スピードアップ： 従来の最も速い方法（cuSPARSE）よりも、最大で 1.63 倍速くなりました。
精度と速度の両立： 精度を落さずに（FP32 レベル）、速度だけを上げたい場合でも、PackSELL はFP16 の速度を超えて動作しました。
複雑な計算も楽々： 連立方程式を解くような難しい計算（共役勾配法など）でも、最大で 2 倍のスピードアップを実現しました。

🌟 まとめ

PackSELLとは、**「データの場所と中身を、無駄なく、自由に組み合わせて詰め込む新しいパッキング術」**です。

場所は「前からの距離」で記録して小さくする。
中身と場所を 1 つの箱にぎゅっと詰める。
箱の形を計算の目的に合わせて自由にカスタマイズする。

これにより、コンピューターが**「重い荷物（データ）」を運ぶ負担を減らし、計算という「仕事」に集中できる**ようにしたのです。

今後の AI や科学シミュレーションがもっと速く、効率的になるための、とても重要な一歩となる技術です。

PackSELL: 精度非依存の高性能 SpMV 向けスパース行列フォーマットの技術的サマリー

本論文は、GPU 上での疎行列 - ベクトル積（SpMV）の高性能化と、多様なデータ表現（特に低精度および非 IEEE 形式）への柔軟な対応を可能にする新しいスパース行列フォーマット「PackSELL」を提案しています。

以下に、問題定義、手法、主要な貢献、実験結果、および意義について詳細にまとめます。

1. 背景と問題定義

SpMV の重要性: 疎行列 - ベクトル積（SpMV）は科学技術計算の基盤となるカーネルであり、特にメモリ帯域幅がボトルネックとなる GPU 環境では、データ移動の削減が性能向上の鍵となります。
混合精度計算の潮流: 近年、FP32（単精度）や FP16（半精度）を用いた混合精度ソルバーが注目されています。さらに、IEEE 754 規格に準拠しないカスタム浮動小数点形式や少数ビット整数形式の利用も検討されています。
既存手法の限界:
- 従来の高効率 SpMV カーネルは、主に FP64 や FP32 といった標準的な IEEE 形式向けに設計されており、他の形式への対応が限られています。
- 既存の圧縮フォーマット（SELL など）は、メモリアクセス効率を高めるために「バイト境界」へのアライメントを暗黙的に仮定しており、非バイトアライメント形式や、インデックスと値を統合的に圧縮する柔軟な設計が困難でした。
- データ表現とメモリアクセス効率の tight coupling（密結合）が、多様な低ビット形式の効率的な利用を阻害していました。

2. 提案手法：PackSELL

提案する PackSELL は、既存の Sliced ELLPACK (SELL) フォーマットを基盤としつつ、以下の 2 つの主要な技術を採用して設計されています。

2.1 列インデックスのデルタ符号化 (Delta Encoding)

各行内の非ゼロ要素の列インデックスを、絶対値ではなく「直前の要素からの差分（デルタ）」として符号化します。
疎行列では隣接する要素の列インデックスが近いことが多いため、この差分は小さな値となり、少ないビット数で表現可能です。

2.2 デルタ - 値のパッキング (Delta-Value Packing)

単一ワードへの格納: 1 つの非ゼロ要素について、その「列インデックスの差分（デルタ）」と「値（Value）」を、1 つのワード（例：32 ビット）にパッキングして格納します。
柔軟なビット割当: ワード内のビットを、デルタ用（ $D$ ビット）と値用（ $V$ ビット）に柔軟に割り当てることができます。これにより、IEEE 754 形式だけでなく、カスタム浮動小数点形式（例：E8MY 形式）や整数形式など、任意のビット幅のデータ表現をサポートします。
フラグ付きエンコーディング:
- 通常の場合（フラグ=1）: $D$ ビットでデルタ、 $V$ ビットで値を格納します。
- 過大デルタの場合（フラグ=0）: 差分が $D$ ビットで表現できない場合、フラグを 0 にし、値を格納せずに $W-1$ ビット全てをデルタの格納に使用します。この場合、実際の非ゼロ要素の前にダミー要素を挿入することで、元の値を復元可能にしています。
ブランチフリーな復元: GPU での高速実行のため、パッキングされたデータから値とデルタを復元する際、条件分岐を含まない演算（シフト演算とマスク）のみで処理できるように設計されています。

2.3 SELL 形式との統合

SELL の特徴である「行のスライス化（Slice）」と「パディング」の仕組みを維持しつつ、パッキングされたデータを pack 配列として格納します。
行の並べ替え（Row Permutation）もサポートしており、パディング量を最小化します。

3. 主要な貢献

新しいスパース行列フォーマット PackSELL の提案:
- 多様なデータ形式（IEEE 形式、非 IEEE 形式、整数形式など）を統一的にサポートし、GPU 上で高性能な SpMV を実現するフォーマット。
SpMV カーネルおよび Krylov 部分空間法の性能評価:
- 単体の SpMV カーネルとしての性能だけでなく、混合精度ソルバー（F3R、IO-CG）への統合による全体性能の向上を実証。
非 IEEE 形式の有用性の実証:
- 特定の行列特性やアプリケーションに合わせて、指数部と仮数部のビット数を最適化できることが、FP16 や BF16 単体では達成できない「FP32 レベルの精度と FP16 レベルの性能」の両立を可能にすることを示しました。

4. 実験結果

NVIDIA A100 GPU 上で、SuiteSparse 集合から選ばれた 435 枚の行列および 30 枚の線形ソルバー用行列を用いて評価を行いました。

4.1 単体 SpMV カーネルの性能

FP16 環境での比較:
- PackSELL（FP16 値、 $D=15$ ）は、NVIDIA cuSPARSE の SELL 実装（cuSELL）に対し、最大 1.63 倍の高速化を達成しました。
- 疎なパターンが規則的な 292 枚の行列（SELL 適性行列）において、cuSELL を上回るケースが 201 枚ありました。
- 既存の DASP や cuCSR に対しても、最大で 5 倍以上の高速化が見られました。
非 IEEE 形式（E8MY）の性能:
- 仮数部のビット数を調整したカスタム形式（E8MY）を用いることで、FP16 cuSELL よりも高い精度（FP32 相当の誤差）を維持しつつ、FP16 並みの高速性能を達成しました。
- 特に、動的範囲が広い行列において、FP16 ではアンダーフローが発生するケースでも、カスタム形式では安定した計算が可能でした。

4.2 混合精度ソルバーへの適用

F3R ソルバー（FP16 対応）:
- PackSELL を使用した F3R ソルバーは、標準的な FP16 実装に対し最大 1.32 倍、FP64 実装に対し最大 2.64 倍の高速化を達成しました。
Inner-Outer CG ソルバー:
- 内部反復にカスタム形式（E8MY）を用いた IO-CG ソルバーは、標準的な FP64 PCG に対し最大 2.09 倍の高速化を達成しました。
- 従来の FP16 や BF16 を用いた混合精度ソルバーでは、精度不足による反復数の増加で性能が低下するケースがありましたが、PackSELL の柔軟なビット割当により、精度と性能のバランスを最適化できました。

5. 意義と結論

データ表現の柔軟性: PackSELL は、データ表現を固定された属性として扱うのではなく、インデックス符号化やメモリレイアウトと統合して設計することで、非バイトアライメント形式やカスタム形式の効率的な利用を可能にしました。
メモリ帯域幅の効率化: デルタ符号化とパッキングによるメモリ footprint の削減が、メモリ帯域幅に制約される SpMV の性能向上に直接寄与しています。
将来の混合精度ソルバーへの基盤: 標準的な IEEE 形式だけでは達成困難な「高精度かつ高速」な混合精度ソルバーの実現を可能にするため、将来の高性能計算（HPC）におけるソルバー設計の重要な基盤技術となります。

本論文は、GPU における疎行列計算の新たなパラダイムを示し、特に低精度・カスタム形式を用いた次世代ソルバーの実用化に大きく貢献するものです。