Characterising the failure mechanisms of error-corrected quantum logic gates
Este estudo utiliza um código heavy-hex em uma matriz de qubits supercondutores para caracterizar mecanismos de falha em portas lógicas quânticas com correção de erros, revelando que erros de ociosidade durante a leitura e o ruído de medição são fatores dominantes que podem ser mitigados através de circuitos de extração de síndrome otimizados, ao mesmo tempo em que se equilibram os ganhos de estabilidade contra o tempo de decaimento da memória.
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Para construir um computador que possa resolver problemas além do alcance das máquinas de hoje, cientistas estão tentando criar um novo tipo de processador que utilize as estranhas regras da física quântica. Essas máquinas dependem de unidades delicadas de informação chamadas qubits, que podem existir em múltiplos estados ao mesmo tempo. No entanto, os qubits são incrivelmente frágeis; a menor perturbação proveniente de calor ou ruído elétrico pode corromper a informação que eles contêm, fazendo com que o cálculo falhe. Para se proteger contra isso, pesquisadores utilizam uma técnica chamada correção de erros. Em vez de depender de um único qubit, eles agrupam muitos qubits físicos para formar um único qubit "lógico", mais robusto. Este sistema verifica a si mesmo constantemente, de forma muito semelhante a um corretor ortográfico escaneando um documento em busca de erros de digitação, ao medir padrões específicos dos qubits sem olhar para os dados reais. Se um erro é detectado, o sistema pode corrigi-lo antes que ele se espalhe. O objetivo final é tornar esses qubits lógicos estáveis o suficiente para executar programas complexos, mas chegar lá exige entender exatamente como e por que esses sistemas de proteção falham em hardware real.
Uma equipe de pesquisadores deu recentemente um passo significativo em direção a esse objetivo ao testar esses sistemas de correção de erros em um processador quântico real fabricado pela IBM. Eles focaram em um design específico conhecido como código heavy-hex, que organiza os qubits em um padrão que se ajusta bem ao layout físico da máquina. Os pesquisadores queriam entender dois desafios críticos: quão bem o sistema consegue armazenar informação ao longo do tempo e quão bem ele consegue realizar operações lógicas, que são os cálculos propriamente ditos. Para fazer isso, eles realizaram dois tipos de experimentos. O primeiro foi um teste de memória, onde simplesmente tentaram manter um qubit lógico vivo pelo maior tempo possível enquanto o sistema verificava erros. O segundo foi um teste de estabilidade, que simulou uma operação de porta lógica para ver se o sistema conseguiria completar um cálculo com sucesso, apesar do ruído e das imperfeições do hardware.
Em seu experimento de memória, a equipe descobriu que a maneira como verificavam os erros estava causando mais mal do que bem. Na abordagem padrão, a máquina mede um tipo de erro, redefine as ferramentas de medição e, em seguida, mede um segundo tipo. Esse processo leva muito tempo e, enquanto a máquina espera, os qubits naturalmente perdem sua informação devido a um processo de decaimento lento. Os pesquisadores redesenharam o circuito para medir ambos os tipos de erros ao mesmo tempo e eliminaram a necessidade de redefinir as ferramentas de medição entre as verificações. Ao fazer isso, reduziram o tempo necessário para um ciclo completo de verificação de erros de 11,1 microssegundos para apenas 3,2 microssegundos. Essa aceleração teve um efeito dramático: a taxa de sobrevivência do qubit lógico saltou de menos de 90 por cento para mais de 96 por cento por ciclo. A equipe descobriu que o principal inimigo não era a medição em si, mas o tempo que os qubits passavam esperando ociosamente enquanto as medições eram realizadas.
A segunda parte do estudo analisou o que acontece quando a máquina tenta realizar uma porta lógica, uma operação fundamental necessária para qualquer cálculo. Aqui, os pesquisadores testaram se repetir as verificações de erro várias vezes tornaria a operação mais confiável. Eles descobriram que, à medida que aumentavam o número de verificações, a chance de a operação falhar diminuía de fato, mostrando que o sistema estava funcionando conforme pretendido para suprimir erros. No entanto, eles também notaram uma compensação. Cada verificação extra leva mais tempo, e esse tempo adicional dá aos qubits mais oportunidades de decair naturalmente. Os pesquisadores compararam duas versões do experimento: uma que utilizava um procedimento de redefinição padrão após cada medição e outra que pulava a redefinição e, em vez disso, utilizava uma atualização de software para rastrear as mudanças. Surpreendentemente, eles descobriram quase nenhuma diferença de desempenho entre as duas. Isso foi inesperado porque teorias anteriores sugeriam que pular a redefinição introduziria novos tipos de erros. A equipe concluiu que, nesta máquina específica, o processo de redefinição é tão ruidoso quanto a própria medição, portanto, remover a redefinição não proporcionou o benefício esperado.
Para entender exatamente quais partes da máquina estavam causando mais problemas, os pesquisadores construíram uma simulação computacional detalhada que imitava o comportamento de seu dispositivo físico. Eles alimentaram a simulação com dados sobre a frequência com que a máquina cometia erros em suas portas, a frequência com que lia incorretamente os resultados de uma medição e o quanto os qubits derivavam enquanto esperavam. Ao ajustar esses números na simulação, eles puderam ver qual fator tinha o maior impacto no resultado final. A simulação revelou que o ruído de medição era o problema dominante. Erros na leitura do estado dos qubits foram muito mais prejudiciais ao sucesso das portas lógicas do que erros nas próprias portas ou o tempo que os qubits passaram esperando. Essa descoberta sugere que simplesmente fazer os qubits durarem mais ou tornar as portas mais precisas não será suficiente para resolver o problema. Em vez disso, o caminho mais crítico a seguir é melhorar a velocidade e a precisidade das medições de meio de circuito — o processo de leitura dos qubits enquanto o computador está em execução.
O estudo fornece um roteiro claro para a próxima geração de computadores quânticos. Ele mostra que, embora o hardware atual possa armazenar e processar informações com correção de erros, o desempenho é atualmente limitado pela rapidez e precisão com que a máquina lê seu próprio estado. Os pesquisadores demonstraram que, ao otimizar o tempo dessas leituras e remover etapas desnecessárias, poderiam aumentar significativamente a confiabilidade do sistema. O trabalho deles confirma que o caminho para um computador quântico de grande escala e tolerante a falhas não reside apenas em construir melhores qubits, mas em projetar todo o sistema para minimizar o tempo que essas unidades frágeis passam expostas ao ambiente ruidoso. Os resultados indicam que, se os dispositivos futuros puderem medir os qubits de forma mais rápida e com menos erros, a taxa de sucesso de operações quânticas complexas melhorará drasticamente, aproximando o sonho de um computador quântico prático da realidade.
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