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Silicon Photonics Testing: Design for Testability, Fault Detection, and Manufacturing Variation Analysis in Photonic Integrated Circuits

Dieses Papier schlägt eine Design-for-Test (DFT)-Methodik und -Architektur für siliziumphotonische integrierte Schaltkreise vor und validiert diese, wobei es deren Wirksamkeit bei der Erkennung von Fehlern sowie der Verifizierung von Signalleistung und -phase über diverse Anwendungen hinweg, einschließlich optischer neuronaler Netze und Logikschaltungen mit Rückkopplungsschleifen, demonstriert.

Ursprüngliche Autoren: Pratishtha Agnihotri, Priyank Kalla, Steve Blair

Veröffentlicht 2026-06-09

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CC0 1.0

Ursprüngliche Autoren: Pratishtha Agnihotri, Priyank Kalla, Steve Blair

Originalarbeit unter CC0 1.0 der Gemeinfreiheit gewidmet (http://creativecommons.org/publicdomain/zero/1.0/). ✨ Dies ist eine KI-generierte Erklärung des untenstehenden Papers. Sie wurde nicht von den Autoren verfasst oder gebilligt. Für technische Genauigkeit konsultieren Sie das Originalpaper. Vollständigen Haftungsausschluss lesen

Stellen Sie sich vor, Sie bauen eine riesige, unglaublich komplexe Stadt aus Glasröhren. In dieser Stadt bewegen sich statt Autos Lichtstrahlen durch die Rohre, um Informationen zu transportieren. Dies ist die Welt der Silizium-Photonik. Es ist eine superschnelle, hochtechnologische Art, Daten zu bewegen, aber es gibt einen Haken: Da die Rohre so winzig sind (kleiner als ein menschliches Haar), kann selbst ein mikroskopisch kleiner Staubpartikel oder ein winziger Fehler beim Schneiden das gesamte System ruinieren. Wenn die Rohre auch nur minimal die falsche Breite haben, kann das Licht verloren gehen, verspätet ankommen oder auf unkontrollierte Weise mit anderen Lichtstrahlen kollidieren.

Das von Ihnen bereitgestellte Paper handelt davon, ein spezielles „Inspektionsteam“ direkt in diese Glasstädte einzubauen, um Fehler abzufangen, bevor die Stadt fertiggestellt ist.

Hier ist eine Aufschlüsselung ihrer Lösung unter Verwendung einfacher Analogien:

1. Das Problem: Das „Gespenst“ in der Maschine

In der traditionellen Elektronik (wie den Chips in Ihrem Telefon) haben wir bewährte Methoden, um zu testen, ob ein Schaltkreis funktioniert. Aber in diesen lichtbasierten Chips ist es schwierig, hineinzuschauen, ohne den Fluss zu unterbrechen.

Das Problem: Wenn ein Rohr während der Herstellung etwas zu breit oder zu schmal gebaut wird, verändert sich das Lichtsignal. Es könnte schwächer werden (Leistungsverlust) oder einen Bruchteil einer Sekunde zu spät ankommen (Phasenverschiebung).
Die Konsequenz: Der Chip könnte eine „1“ interpretieren, obwohl es eine „0“ sein sollte, oder die Daten könnten einfach verschwinden. Derzeit ist das Beheben eines solchen Fehlers so, als würde man versuchen, ein Radio durch Raten abzustimmen; es ist langsam, manuell und teuer.

2. Die Lösung: Die „Geschmackstest“-Architektur

Die Autoren schlagen eine Methode namens „Design-for-Test“ (DFT) vor. Stellen Sie sich das wie eine eingebaute „Geschmackstest“-Station direkt in der Fabrikationslinie des Chips vor.

Anstatt das Licht einfach nur von Punkt A nach Punkt B fließen zu lassen, setzen sie ein spezielles Bauteil ein, das gleichzeitig wie ein Verkehrspolizist und ein Spiegel fungiert.

Die Schlüsselkomponente: Der Mach-Zehnder-Modulator (Der „Splitter“)

Stellen Sie sich einen Fluss (das Lichtsignal) vor, der durch einen Kanal fließt. Die Autoren setzen in der Mitte einen speziellen Damm ein, den sogenannten Mach-Zehnder-Modulator (MZM).

Normalbetrieb: Wenn der Chip normal arbeitet, ist der Damm offen und der Fluss fließt geradewegs durch zum nächsten Teil der Stadt.
Testmodus: Wenn es Zeit ist, Fehler zu prüfen, wird der Damm so eingestellt, dass er eine kleine Probe des Wassers (30 % des Lichts) abzapft und in einen Seitenkanal zur Inspektion leitet. Der Rest des Wassers fließt weiter, damit der Chip weiterarbeiten kann.

Der Vergleich: Der „Y-Combiner“ (Die „Auslöschungs-Maschine“)

Sobete die Lichtprobe abgezapft wurde, muss sie überprüft werden. Woher wissen wir, ob sie „falsch“ ist?

Die Autoren erstellen eine perfekte, ideale Version dessen, wie das Licht aussehen sollte. Nennen wir dies das „Referenzsignal“.
Sie nehmen das Probensignal (aus dem Chip) und das Referenzsignal (das perfekte Ideal) und führen sie in einem Y-förmigen Rohr (Y-Combiner) zusammen.
Der magische Trick: Sie stellen es so ein, dass sich die beiden Signale vollständig gegenseitig auslöschen, wenn sie identisch sind (ähnlich wie bei Noise-Cancelling-Kopfhörern). Das Ergebnis ist Stille (kein Licht).
- Stille = Gut: Der Chip ist perfekt.
- Licht = Schlecht: Wenn Licht aus dem Y-Rohr austritt, bedeutet das, dass das Probensignal nicht mit dem Referenzsignal übereinstimmt. Es liegt ein Defekt vor!

3. Die Erprobung

Die Autoren haben ihr „Inspektionsteam“ an zwei sehr unterschiedlichen Arten von Licht-Städten getestet:

Fall A: Das Optische Neuronale Netzwerk (Das „Gehirn“)
- Dies ist ein Chip, der darauf ausgelegt ist, wie ein menschliches Gehirn zu denken, indem er Schichten von Lichtröhren nutzt.
- Sie ersetzten einen der Standard-Lichtschalter im Gehirn durch ihre „Inspektionsstation“.
- Ergebnis: Als sie einen Defekt simulierten (ein leicht verbogenes Rohr), erfasste die Inspektionsstation diesen sofort, da das Licht nicht perfekt auslöschte.
Fall B: Der Optische Logikschaltkreis mit Schleifen (Der „Kreisverkehr“)
- Dies ist ein Chip, in dem die Lichtrohre wie in einem Kreisverkehr um sich selbst herumführen. Das ist komplizierter, da das Licht ständig im Kreis fließt.
- Sie konnten nicht einfach einen Teil innerhalb der Schleife ersetzen, also setzten sie ihre Inspektionsstation zwischen zwei Teile der Schleife.
- Ergebnis: Selbst während das Licht im Kreis fuhr, konnte die Station erfolgreich erkennen, wenn ein Teil der Schleife defekt war.

Zusammenfassung

Kurz gesagt sagen die Autoren: „Warten Sie nicht, bis der Chip fertig ist, um zu sehen, ob er funktioniert. Bauen Sie eine integrierte Qualitätskontrollstation ein, die ein wenig Licht abzapft, es mit einem perfekten Ideal vergleicht und Ihnen sofort mitteilt, wenn es einen Fehler gibt.“

Sie haben bewiesen, dass dies funktioniert, indem sie den gesamten Prozess am Computer simulierten, die winzigen Glasröhren entwarfen und zeigten, dass ihre „Auslöschungsmethode“ selbst kleinste Fertigungsfehler in komplexen lichtbasierten Computern aufspüren kann. Dies könnte dazu beitragen, diese hochtechnologischen Chips in Zukunft billiger und zuverlässiger zu machen.

Technisches Resümee: Testen von Silizium-Photonik: Design for Testability, Fehlererkennung und Analyse von Fertigungsvariationen in photonischen integrierten Schaltkreisen

Problemstellung
Die schnelle Expansion der Silizium-Photonik hin zu hochbandbreitigen, kosteneffizienten Interconnects und komplexen Systemen wie optischen neuronalen Netzen (ONNs) und optischen Logikschaltungen wird durch den hohen Brechungsindexkontrast von Silizium-auf-Isolator (SOI) und die Kompatibilität mit CMOS-Prozessen vorangetrieben. Diese Technologie steht jedoch vor erheblichen Herausforderungen hinsichtlich der Fertigungsausbeute und Zuverlässigkeit. Silizium-photonische Schaltkreise reagieren äußerst empfindlich auf geringfügige geometrische Diskrepanzen (z. B. Variationen in Wellenleiterbreite oder -dicke), die in der Fertigung inhärent sind. Diese Abweichungen pflanzen sich durch komplexe Schaltkreise fort, verändern die Signalleistung sowie die Phase und führen letztlich zu fehlerhaften Interferenzmustern und damit zu einer Verschlechterung der Leistung. Während Post-Fabrikations-Tuning und Kalibrierung notwendig sind, sind die derzeitigen Prozesse weitgehend manuell, mühsam und lassen Automatisierung vermissen. Darüber hinaus besteht eine deutliche Forschungslücke hinsichtlich automatisierter Design-for-Test (DFT)-Architekturen, die speziell darauf ausgelegt sind, das Testen, Diagnostizieren und Kalibrieren von photonischen integrierten Schaltkreisen (PICs) zu vereinfachen.

Methodik
Die Autoren schlagen eine spezifikationsbasierte DFT-Architektur vor, die direkt in Silizium-PICs eingebettet werden kann. Die Kernmethodik umfasst:

Testzugriff und Signalabgriff: Nutzung eines Mach-Zehnder-Modulators (MZM) auf Basis von Ladungsinjektion, um einen Teil des optischen Signals an spezifischen Testpunkten abzugreifen. Der MZM ist so konzipiert, dass er in einer „intermediären Konfiguration“ (Testmodus) arbeitet, bei der ein bestimmter Prozentsatz (30 %) des Signals für den Test abgeleitet wird, während der Rest durch den Schaltkreis weiterläuft.
Fehlererkennung durch Vergleich: Das abgegriffene Testsignal (Amplitude $S_T$ , Phase $\phi_T$ ) wird mittels eines Y-Combiners mit einem bekannten Referenzsignal ( $S_R$ , $\phi_R$ ) verglichen. Der Y-Combiner fungiert als Komparator; wenn der Schaltkreis fehlerfrei ist, sind das Test- und das Referenzsignal so konzipiert, dass sie die gleiche Magnitude, aber die entgegengesetzte Phase besitzen, was zu destruktiver Interferenz und einem Null-Ausgang führt. Jede Abweichung von Null deutet auf einen Defekt hin.
Komponentendesign und Simulation: Die DFT-Schaltkreis-Komponenten – Richtkoppler, Phasenmodulatoren und Y-Combiner – wurden entworfen und umfassend mit Ansys Lumerical-Suites (FDE, varFDTD, FDTD, CHARGE und INTERCONNECT) simuliert.
- Richtkoppler: Entworfen als 3dB-Koppler mit optimierten Wellenleiterabständen und -längen, um eine präzise Leistungsteilung (Zielsetzung einer 50:50-Verteilung) zu gewährleisten und gleichzeitig Reflexionsverluste zu minimieren.
- Phasenmodulatoren: Modelliert unter Verwendung der Drude-Expansion, um Änderungen des Brechungsindex ( $\Delta n$ ) und der Absorption ( $\Delta \alpha$ ) basierend auf Änderungen der Ladungsträgerkonzentration zu berechnen, die durch spannungsgesteuerte p-n-Übergänge induziert werden.
- MZM-Assemblierung: Integration von Richtkopplern und Phasenmodulatoren, um einen schaltfähigen MZM zu erstellen. Ein 5-mm-Modulationsarm wurde gewählt, um den Footprint und die Schaltspannung (~5,6 V für vollständiges Schalten) auszubalancieren und die unpraktikable Anforderung von 16 V bei kürzeren 3-mm-Armen zu vermeiden.
Validierungsszenarien: Die Methodik wurde auf zwei unterschiedliche PIC-Topologien angewendet:
- Ein Feed-Forward Optical Neural Network (ONN), bei dem ein Standard-MZI durch den DFT-MZM ersetzt wurde.
- Eine optische Logikschaltung mit Rückkopplungsschleifen (BCD-zu-7-Segment-Anzeige), bei der der DFT-Schaltkreis extern zwischen den Knoten eingefügt wurde, um die geschlossene Topologie nicht zu stören.

Wesentliche Beiträge

DFT-Architektur: Das Paper präsentiert eine neuartige DFT-Architektur speziell für die Silizium-Photonik, die das On-Chip-Testen der Signalleistung und -phase gegen eine Referenz ermöglicht.
Komponentendesign: Detailliertes Design und Simulation der Bestandteile des DFT-Schaltkreises (3dB-Richtkoppler, Ladungsinjektions-Phasenmodulatoren und Y-Combiner).
Demonstration der Fehlererkennung: Die Autoren demonstrieren die Fähigkeit zur Erkennung von Fertigungsfehlern (simuliert als Phasenverschiebungsfehler oder Leistungsabweichungen) sowohl in Feed-Forward- als auch in Feedback-Loop-Schaltungstopologien.
Spezifikationsbasiertes Testen: Der Ansatz validiert den Betrieb der Schaltung durch den Vergleich tatsächlicher Signalcharakteristika mit idealen Spezifikationen, anstatt sich rein auf binäre Pass/Fail-Ergebnisse zu verlassen.

Ergebnisse

Komponentenleistung: Der entworfene 3dB-Richtkoppler erreichte eine Leistungsverteilung von 48:48 bei minimierten Reflexionen. Der 5-mm-MZM zeigte eine Einfügedämpfung von 2,6 dB und ein Extinktionsverhältnis von 20,3 dB.
ONN-Testing: Im Feed-Forward-ONN-Test führte ein fehlerfreier Schaltkreis zu destruktiver Interferenz (Null-Ausgang) am Y-Combiner. Als ein Defekt eingeführt wurde (Simulation eines Phasenverschiebefehlers von 2,14 rad statt 3,14 rad), änderte sich der MZM-Ausgang auf 0,1 W, und der Y-Combiner detektierte ein Signal ungleich Null, wodurch die Fehlfunktion erfolgreich identifiziert wurde.
Feedback-Loop-Testing: In der optischen Logikschaltung mit Rückkopplungsschleifen verursachte ein in einem spezifischen MZI eingeführter Defekt ein Signal am Test-Debug-Punkt. Der DFT-Schaltkreis detektierte diese Abweichung erfolgreich und bestätigte damit die Anwendbarkeit der Methodik auf komplexe Topologien mit Zyklen.

Bedeutung und Ansprüche
Das Paper behauptet, dass die vorgeschlagene DFT-Methodik die kritische Notwendigkeit des automatisierten Testens im Silizium-Photonik-Ökosystem adressiert. Durch die direkte Einbettung von Testzugriffs- und Fehlererkennungsschaltkreisen auf dem Chip ermöglicht der Ansatz die Echtzeit-Datenerfassung, Fehlererkennung und Post-Fabrikations-Tuning. Die Autoren führen an, dass diese Architektur die Testzeit und -kosten senken, die Testabdeckung und Zuverlässigkeit erhöhen sowie die Skalierbarkeit und Ausbeute von Silizium-PICs verbessern kann. Die Arbeit dient als grundlegender Schritt hin zu einer CAD-basierten Testinfrastruktur, die die Lücke zwischen aktuellen manuellen Kalibrierungsprozessen und den Anforderungen für die großflächige Fertigung komplexer photonischer Systeme schließt. Die Autoren merken an, dass die Validierung der DFT-Architektur erfolgt ist, die Entwicklung automatisierter Werkzeuge zur Testpunktselektion und zur automatischen Testmustergenerierung (ATPG) jedoch Gegenstand zukünftiger Arbeiten bleibt.