A High-Throughput DSP-Free PRNG for FPGA based on Xoshiro128** and Integer Chaotic Mixing
यह शोध पत्र ज़िलिंक्स ज़िनक-7000 (Xilinx Zynq-7000) प्लेटफॉर्म के लिए एक संसाधन-कुशल, डीएसपी-मुक्त (DSP-free), और पूर्णतः पाइपलाइन्ड हाइब्रिड पीआरएनजी (PRNG) प्रस्तुत करता है जो उच्च थ्रूपुट (5.82 Gbps) प्राप्त करने और कठोर सांख्यिकीय परीक्षणों को पास करने के लिए ज़ोशिरो128** (Xoshiro128**), वेइल अनुक्रमों (Weyl sequences), और एक पूर्णांक टेंट मैप (integer Tent map) को संयोजित करता है, जबकि एम्बेडेड अनुप्रयोगों के लिए उपयुक्त एक छोटा फुटप्रिंट बनाए रखता है।
मूल पेपर CC BY 4.0 (https://creativecommons.org/licenses/by/4.0/) के तहत लाइसेंस किया गया है। नीचे दिए गए पेपर की यह व्याख्या AI से तैयार की गई है। इसे लेखकों ने न तो लिखा है, न इसका समर्थन किया है। तकनीकी सटीकता के लिए मूल पेपर देखें। पूरा डिस्क्लेमर पढ़ें
डिजिटल दुनिया में, कई सिस्टम सही ढंग से कार्य करने के लिए संख्याओं के उन अनुक्रमों (sequences) पर निर्भर करते हैं जो पूरी तरह से यादृच्छिक (random) दिखाई देते हैं। ये अनुक्रम संचार को सुरक्षित करने, जटिल भौतिक प्रणालियों का अनुकरण करने और क्रिप्टोग्राफिक प्रोटोकॉल चलाने के लिए आवश्यक हैं। हालाँकि, मशीन के लिए वास्तविक यादृच्छिकता उत्पन्न करना कठिन है, इसलिए इंजीनियर "छद्म-यादृच्छिक" (pseudo-random) संख्याएँ बनाने के लिए एल्गोरिदम का उपयोग करते हैं। ये नियतात्मक (deterministic) अनुक्रम हैं जो एक पर्यवेक्षक के लिए यादृच्छिक प्रतीत होते हैं लेकिन वास्तव में एक विशिष्ट प्रारंभिक बीज (seed) से शुरू होने वाले नियमों के एक विशेष सेट द्वारा निर्मित होते हैं। चुनौती हार्डवेयर डिजाइनरों के लिए यह है कि वे इन अनुक्रमों को बहुत अधिक बिजली या चिप पर बहुत अधिक जगह घेरे बिना तेजी से और कुशलता से कैसे बनाएं। जब इन जनरेटरों को FPGA नामक विशेष चिप्स में बनाया जाता है, जो अक्सर एम्बेडेड सिस्टम में उपयोग किए जाने वाले पुन: कॉन्फ़िगर करने योग्य हार्डवेयर हैं, तो लक्ष्य उच्च गति प्राप्त करना है जबकि डिजाइन को छोटा और ऊर्जा-कुशल रखना है, उन महंगे, भारी-शक्ति वाले घटकों के उपयोग से बचना है जो आमतौर पर भारी गणितीय गणनाओं के लिए आरक्षित होते हैं।
ईरान के विश्वविद्यालयों के शोधकर्ताओं की एक टीम ने एक नया तरीका विकसित किया है जिससे वे FPGA पर चलने वाला ऐसा जनरेटर बना सकते हैं। उनका काम एक ऐसा उपकरण बनाने पर केंद्रित है जो अधिकांश चिप्स में पाए जाने वाले मानक उच्च-प्रदर्शन गणितीय इकाइयों का उपयोग किए बिना यादृच्छिक दिखने वाली संख्याओं का एक विशाल प्रवाह उत्पन्न करता है। इन विशेष घटकों पर भरोसा करने के बजाय, जो अक्सर सीमित संख्या में होते हैं और महत्वपूर्ण शक्ति की खपत करते हैं, टीम ने एक ऐसी प्रणाली डिजाइन की जो केवल बुनियादी लॉजिक गेट्स और मानक मेमोरी रजिस्टरों का उपयोग करती है। परिणाम एक ऐसा जनरेटर है जो 5.82 गीगाबिट प्रति सेकंड की दर से डेटा उत्पन्न कर सकता है, एक ऐसी गति जो बहुत अधिक जटिल डिजाइनों की बराबरी करती है, जबकि यह चिप के बहुत कम संसाधनों का उपयोग करता है और न्यूनतम बिजली की खपत करता है।
इस नए डिजाइन का मूल एक हाइब्रिड दृष्टिकोण है जो संख्याओं को मिलाने के तीन अलग-अलग तरीकों को जोड़ता है। प्राथमिक इंजन एक प्रसिद्ध एल्गोरिदम है जिसे Xoshiro128** कहा जाता है, जो मुख्य स्रोत के रूप में कार्य करता है। यह इंजन कुशल है और इसके दोहराव से पहले इसका चक्र बहुत लंबा होता है, लेकिन इसमें एक अनुमानित गणितीय संरचना है जिसका उपयोग एक कुशल हमलावर द्वारा किया जा सकता है। इसे ठीक करने के लिए, शोधकर्ताओं ने दो अतिरिक्त मिश्रण परतें जोड़ीं। पहली परत एक सरल योगात्मक प्रक्रिया (additive process) का उपयोग करती है जो मानों को इस तरह से स्थानांतरित करती है जिससे एक अलग प्रकार का पैटर्न बनता है। दूसरी परत एक "टेंट" (tent) मैप का उपयोग करती है, जो संख्याओं को खींचने और मोड़ने की एक विधि है, ठीक वैसे ही जैसे एक बेकर आटे को मोड़ता है, हालांकि इस मामले में, फोल्डिंग भौतिक हेरफेर के बजाय सरल पूर्णांक गणित (integer math) के माध्यम से होती है। ये परतें मिलकर मुख्य इंजन के अनुमानित पैटर्न को तोड़ने के लिए डिज़ाइन की गई हैं, जिससे अंतिम आउटपुट को रिवर्स-इंजीनियर करना बहुत कठिन हो जाता है।
शोधकर्ताओं ने इस प्रणाली को एक हाई-लेवल सिंथेसिस टूल का उपयोग करके बनाया, जो लॉजिक के सॉफ्टवेयर विवरण को चिप के भौतिक लेआउट में स्वचालित रूप से अनुवादित करता है। उन्होंने इस डिजाइन का परीक्षण Xilinx Zynq-7000 नामक एक विशिष्ट प्रकार की चिप पर किया। कार्यान्वयन हर उस मीट्रिक में सफल रहा जो एम्बेडेड अनुप्रयोगों के लिए महत्वपूर्ण है। अंतिम डिजाइन ने चिप पर केवल 934 छोटे लॉजिक ब्लॉक घेरे और 1,071 रजिस्टर का उपयोग किया, जो एक बहुत ही संक्षिप्त पदचिह्न (footprint) है। महत्वपूर्ण रूप से, इसने शून्य विशेष डिजिटल सिग्नल प्रोसेसिंग स्लाइस और शून्य समर्पित मेमोरी ब्लॉक का उपयोग किया, जो यह सिद्ध करता है कि भारी संसाधनों के बिना उच्च-गति यादृच्छिक संख्या पीढ़ी संभव है। सिस्टम 181.82 मेगाहर्ट्ज की आवृत्ति पर चला, जो पहले उल्लेखित उच्च थ्रूपुट प्रदान करता है। बिजली के मामले में, चिप ने संचालन के दौरान केवल 29 मिलीवाट डायनेमिक पावर की खपत की, जो एक निचली सीमा का अनुमान है और यह सुझाव देता है कि डिजाइन अत्यंत ऊर्जा-कुशल है।
यह सुनिश्चित करने के लिए कि उत्पन्न संख्याएं गंभीर उपयोग के लिए वास्तव में पर्याप्त यादृच्छिक हैं, टीम ने आउटपुट को कठोर सांख्यिकीय परीक्षणों की एक बैटरी के अधीन किया। इन परीक्षणों में सरकारी एजेंसियों और स्वतंत्र शोधकर्ताओं द्वारा उपयोग किए जाने वाले मानक सूट शामिल हैं, जो पैटर्न, पूर्वाग्रह (biases) और सहसंबंधों (correlations) की जांच करते हैं जो यादृच्छिकता की कमी का संकेत दे सकते हैं। जनरेटर हर एक परीक्षण में सफल रहा, जिसमें वे सबसे कठिन परीक्षण भी शामिल हैं जो अनुक्रम में सूक्ष्म दोषों की तलाश करते हैं। शोधकर्ताओं ने यह भी विश्लेषण किया कि सिस्टम अपनी शुरुआती स्थितियों में बदलाव के प्रति कितना संवेदनशील था। उन्होंने पाया कि प्रारंभिक सेटअप में एक एकल बिट बदलने से भी आउटपुट पूरी तरह से अलग हो गया, जो प्रारंभिक स्थितियों के प्रति संवेदनशीलता (sensitivity to initial conditions) के रूप में जानी जाने वाली एक विशेषता है। यह सुनिश्चित करता है कि थोड़े अलग बीज के साथ शुरू होने वाले दो उपकरण पूरी तरह से अलग अनुक्रम उत्पन्न करेंगे, जो सुरक्षा के लिए महत्वपूर्ण है।
अध्ययन में प्रत्येक भाग के योगदान का विस्तृत विवरण भी शामिल था। शोधकर्ताओं ने पाया कि मुख्य Xoshiro128** इंजन पहले से ही परीक्षणों को पास करने के लिए सांख्यिकीय रूप से पर्याप्त मजबूत था। जोड़ी गई परतों ने संख्याओं की सांख्यिकीय गुणवत्ता में सुधार नहीं किया, लेकिन उन्होंने कुछ और महत्वपूर्ण किया: उन्होंने उस रैखिक गणितीय संरचना को हटा दिया जिसने मुख्य इंजन को अनुमानित बना दिया था। इन परतों को जोड़कर, शोधकर्ताओं ने इसे काफी कठिन बना दिया है कि कोई हमलावर आउटपुट को देखकर जनरेटर की आंतरिक स्थिति का पता लगा सके। जबकि अकेले मुख्य इंजन को अपेक्षाकृत जल्दी रिवर्स-इंजीनियर किया जा सकता था, पूर्ण हाइब्रिड सिस्टम को तोड़ने के लिए बहुत अधिक जटिल और समय लेने वाले प्रयास की आवश्यकता होती है, जो प्रभावी रूप से गति या दक्षता से समझौता किए बिना जनरेटर को कुछ प्रकार के हमलों से सुरक्षित करता है।
यह कार्य यह सुझाव देता है कि भारी हार्डवेयर घटकों पर निर्भर किए बिना संसाधन-बाधित वातावरण के लिए उच्च-प्रदर्शन वाले रैंडम नंबर जनरेटर बनाना संभव है। डिजाइन एक व्यावहारिक समझौता पेश करता है, जो गति, संसाधन उपयोग और सुरक्षा के बीच संतुलन बनाता है। हालांकि शोधकर्ता नोट करते हैं कि फोल्डिंग लेयर में उपयोग किए गए गणितीय चरण बीजगणितीय रूप से जटिल नहीं हैं, लेकिन अन्य परतों के साथ उनका संयोजन एक मजबूत प्रणाली बनाता है। निष्कर्ष बताते हैं कि यह दृष्टिकोण उन एम्बेडेड सिस्टम के लिए बहुत उपयुक्त है जहाँ स्थान और शक्ति की कमी होती है, जो यादृच्छिकता का एक विश्वसनीय स्रोत प्रदान करता है जिसे विभिन्न प्रकार के उपकरणों में एकीकृत किया जा सकता है। शोधकर्ताओं ने अपने कोड और डेटा को दूसरों के सत्यापन और निर्माण के लिए उपलब्ध कराया है, जिससे यह सुनिश्चित होता है कि परिणामों को पुनरुत्पादित किया जा सके और डिजाइन को भविष्य की जरूरतों के लिए अनुकूलित किया जा सके।
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