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Beyond Tokens: Enhancing RTL Quality Estimation via Structural Graph Learning

本論文は、制御データフローグラフとポストマッピング・ネットリストからの知識蒸留を活用することで、面積や遅延といったRTL設計品質指標の推定において既存のLLMベースの手法を大幅に上回る性能を実現する、新しい構造認識型グラフ自己教師あり学習フレームワークであるStructRTLを提案する。

原著者： Yi Liu, Hongji Zhang, Yiwen Wang, Dimitris Tsaras, Lei Chen, Mingxuan Yuan, Qiang Xu

公開日 2026-06-01

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CC BY 4.0

原著者： Yi Liu, Hongji Zhang, Yiwen Wang, Dimitris Tsaras, Lei Chen, Mingxuan Yuan, Qiang Xu

原論文は CC BY 4.0 (http://creativecommons.org/licenses/by/4.0/) でライセンスされています。 ✨ これは以下の論文のAI生成解説です。著者が執筆または承認したものではありません。技術的な正確性については原論文を参照してください。免責事項の全文を読む

あなたは、巨大で複雑な超高層ビルを設計している建築家だと想像してください。コンクリートを流し込んだりレンガを積み上げたりする前に、あなたはこう考えたいはずです。「このビルは重すぎるのではないか？エレベーターの速度は遅すぎないだろうか？」

コンピュータチップ設計の世界では、エンジニアはまさにこれに直面しています。彼らは、チップがどのように動作すべきかを記述するために、コード（RTLと呼ばれます）を書きます。チップが十分に高速か、あるいは十分に小型であるかを知るために、彼らは通常、「ロジック合成」と呼ばれる大規模で低速なコンピュータシミュレーションを実行しなければなりません。これは、サイズを測定するためだけに、実物大のモデルを建設するようなものです。これには膨大な時間がかかり、設計プロセス全体を遅らせてしまいます。

提供された論文は、StructRTLという新しいツールを紹介しています。これは、設計図（コード）を見て、モデルを構築する前に、建物の重量や速度を瞬時に推測できる「超高速な水晶玉」のようなものです。

その仕組みを、シンプルな概念に分解して説明します。

1. 問題点：間違った本を読んでいる

この「水晶玉」を作ろうとする過去の試みには、主に2つの手法があり、どちらにも欠点がありました。

「トークン」法（LLM）: これは、賢いロボットに設計図を一行ずつ、単語ごとに読ませるようなものです。ロボットは文法や語彙の理解には優れていますが、部屋同士がどのように接続されているかという「全体像」を見落としがちです。ロボットは「ドア」や「廊下」という言葉は見えますが、それらの間の複雑な構造的フローを完全には把握できません。
「手作り」法: これは、人間に窓やドアの数を数えさせ、その数字を単純な計算機に入力させるようなものです。これはあまりに硬直的であり、設計における微妙で複雑な関係性を見逃してしまいます。

2. 解決策：「構造マップ」（CDCFG）

著者たちは、チップの性能を予測するためには、単なるテキストではなく、その骨格を見る必要があると気づきました。彼らは、**制御データフローグラフ（CDFG）**と呼ばれる特別なマップを使用します。

比喩: 設計図を「地下鉄の路線図」に変える様子を想像してください。
- ノード（駅）: これらは演算（数値の加算など）やストレージ（メモリレジスタ）を表します。
- エッジ（線路）: これらはデータが一つの駅から別の駅へとどのように流れるかを示します。
- 違い: テキスト文書とは異なり、このマップは各パーツが「どのように」接続されているかを明示的に示します。これにより、コードの中に隠された「交通渋滞（遅延）」や「建設コスト（面積）」が明らかになります。

3. StructRMLの学習方法：「穴埋めゲーム」

マップを単に暗記するのではなく、StructRTLは自己教師あり学習と呼ばれるゲームを通じて自らを教え込みます。これは、先生が地下鉄の路線図の一部を隠し、生徒に足りない部分を推測させるようなものです。

タスク1：駅のタイプを当てる（マスクされたノードモデリング）: コンピュータはマップ上の駅を隠し、「これは『駅』（加算器）か、それとも『バス停』（メモリレジスタ）か？」と問いかけます。正解するためには、AIは周囲の線路のコンテキスト（文脈）を理解しなければなりません。これにより、AIは各パーツが「何をしているのか」を学びます。
タスク2：線路を当てる（エッジ予測）: コンピュータは駅をつなぐ線を隠し、「駅Aから駅Bへ線路は通っているか？」と問いかけます。これにより、AIは設計の「構造」とフローを理解することを強制されます。

これらのゲームを、何千もの設計に対して何百万回も繰り返すことで、AIはチップの「構造を感じ取る」方法を学びます。特定の接続パターンは通常、チップが遅くなることを意味し、別のパターンはチップが小型であることを意味するということを学習するのです。

4. 秘訣：「教師・生徒」によるコーチング

優れたマップがあったとしても、マップは抽象的なスケッチであり、完成した建物ではないため、最終的な重量や速度を予測するのは困難です。さらに精度を高めるために、StructRTLは**知識蒸留（Knowledge Distillation）**戦略を使用しています。

比喩: すでに超高層ビルを建設し、その正確な重量と速度を知っている**「熟練の建築家（教師）」**を想像してください。
プロセス: 熟練の建築家は、完成した建物を見て、その詳細を**「生徒（StructRTL）」**に説明します。生徒は、マスターの理解を模倣しようとします。
結果: 生徒は、完成した建物の「低レベルな秘密」を学び、それを設計図に適用します。これにより、生徒は建物全体を構築することなく、マップを見るだけで驚くほど正確な予測を行うことができるようになります。

5. 結果：高速かつ正確

論文によれば、この新しい手法は大幅な改善を実現しています。

速度: 従来のメソッドでは約14秒かかるのに対し、この手法はチップの品質を数分の一秒（約0.1秒）で予測します。これは145倍の高速化です。
精度: 巨大なAI言語モデルを含む従来のあらゆる手法よりも、チップのサイズ（面積）と速度（遅延）の両方を推測する能力において、はるかに優れています。
小規模データ: データが乏しい新しいチップ技術においても、この手法はうまく機能します。これは、データが不足しがちな新しいチップ技術において非常に重要です。

まとめ

StructRTLは、コンピュータチップのデザインがどれほど優れているかを予測する新しい方法です。コードを物語のように読んだり、スプレッドシートのように部品を数えたりするのではなく、コードを構造マップに変換し、そのマップ上の接続関係を理解するようにAIを訓練します。マップの欠けている部分を埋めるようにAIを教え、チップを実際に構築した「熟練の建築家」から学ばせることで、エンジニアは設計が高速で効率的であるかどうかを瞬時に判断でき、待ち時間の数時間を節約することができます。

技術要約：Beyond Tokens: 構造グラフ学習によるRTL品質推定の高度化

問題提起

電子設計自動化（EDA）のワークフローにおいて、Register Transfer Level（RTL）設計の品質（具体的には面積や遅延などの指標）を推定することは、フルロジック合成の計算コストをかけずに即時的なフィードバックを提供するために極めて重要である。近年の手法では、大規模言語モデル（LLM）を活用してRTLコードのトークンから埋め込みを導出する試みがなされているが、著者らはこれらの手法が不可欠な構造的意味論を見落としていると主張している。トークンベースのビューは構造情報を暗黙的に符号化するが、制御データフローグラフ（CDFG）は設計の構造的特性を明示的に露出させ、より豊かな表現学習のための手がかりを提供する。さらに、既存のグラフベースの手法は、多くの場合、ダウンストリームの性能に影響を与える複雑なパターンを捉えきれない、浅い手作りの特徴量に依存している。

手法

本論文では、RTL設計品質の推定を改善するために設計された、構造認識型のグラフ自己教師あり学習フレームワークであるStructRTLを提案する。その手法は、主に以下の4つのコンポーネントで構成される。

1. CDFGの構築

生のRTLコードトークンを処理する代わりに、StructRTLは制御データフローグラフ（CDFG）上で動作する。構築パイプラインは以下の通りである：

Yosysを用いて、RTLソースコードをRTL中間言語（RTLIL）にコンパイルする。
Stagira Verilogパーサーを用いて、RTLILから抽象構文木（AST）を生成する。
ASTを走査してCDFGを抽出する。ここで、ノードは演算または記憶素形を表し、有向エッジはデータまたは制御の依存関係を示す。

2. モデルアーキテクチャ

StructRTLは、グラフニューラルネットワーク（GNN）とTransformerエンコーダを組み合わせたハイブリッドアーキテクチャを採用している：

初期化: ノード埋め込みは、ノードタイプのワンホットエンコーディングとノード幅を結合することによって初期化される。
GNN処理: グラフ同型ネットワーク（GIN）がメッセージパッシングを行い、コンテキスト認識型の埋め込みを生成する。
位置エンコーディング: グラフをフラット化する際に失われる構造情報を保持するため、有向グラフの対称正規化ラプラシアン行列の固有ベクトルを用いて、グローバルな位置エンコーディングを算出する。
Transformerエンコーダ: コンテキスト認識型の埋め込みは、位置エンコーディングと共にTransformerエンコーダによって処理され、最終的な構造情報に基づいた埋め込みが生成される。

3. 自己教師あり学習による事前学習

豊かな表現を学習するために、モデルはCDFGに対して2つのカスタマイズされた事前学習タスクを実行する：

構造認識型マスク・ノード・モデリング: 生の特性をマスクする標準的な手法とは異なり、このタスクでは事後GNNコンテキスト認識型埋め込みをマスクする。モデルは、マスクされたノードの元のノードタイプ（32クラスの分類問題）を予測する。深刻なクラス不均衡（例：稀な演算子 vs 一般的なワイヤ）に対処するため、著者らは層化マスキング（各クラスの最小サンプル数を確保）とクラスバランス型フォーカルロスを採用している。
エッジ予測: グラフをTransformer用にフラット化すると接続性が不明瞭になるため、このタスクではエッジの復元を二値分類問題として扱う。モデルは、最終的な埋め込みに基づき、2つのノード間にエッジが存在するかどうかを予測する。これには多層パーセプトロン（MLP）を使用する。

4. 知識蒸留

RTLレベルのCDFGと、面積や遅延が測定される実際のポストマッピング（PM）ネットリストとの間のギャップを埋めるために、著者らは知識蒸留戦略を組み込んでいる：

まず、合成されたネットリスト（GINを使用）を用いてPMベースの予測器を学習し、凍結させる。
この予測器が、余弦類似度と平均二乗誤差を組み合わせた損失関数を介して最終層の活性化を整列させることにより、CDFGベースの予測器（StructRTL）をガイドする。これにより、ゲートレベルの視点からの低レベルの洞察をRTLレベルのモデルへと転移させる。

主な貢献

StructRTLフレームワーク: トークンシーケンスではなく、構造的意味論を捉えるためにCDFGを明示的に活用する、新しい自己教師あり学習フレームワーク。
カスタマイズされた事前学習タスク: 生のCDFGノードをマスクすることに伴う曖昧さの問題に対処し、計算グラフに特化した構造認識型マスク・ノード・モデリングとエッジ予測の導入。
クロスステージ監督: RTLレベルの推定器の予測精度を高めるための、ポストマッピング・ネットリストからの知識蒸留の統合。
オープンソース: さらなる研究を促進するために、コードを公開。

実験結果

著者らは13,200個の設計を含むデータセットを用いて、StructRTLをグラフベースのベースライン（Graph-XGBoost, Graph-GNN）およびLLMベースのベースライン（CodeVのバリアント）と比較評価した。

性能: 知識蒸留なしの場合、StructRHLは面積予測で0.7463、 $R^2$ スコアを、遅延予測で0.7630を達成し、従来の最先端のLLMベースの手法（それぞれ約0.63および0.52）を大幅に上回った。
知識蒸留あり: 知識蒸留戦略を組み込むことで、StructRTLは面積で0.8676、 $R^2$ を、遅延で0.8872までさらに向上し、すべてのベースラインを凌駕した。
アブレーション研究: いずれかの事前学習タスク（マスク・ノード・モデリングまたはエッジ予測）を除去すると性能が低下し、両方のタスクの必要性が確認された。
データの効率性: StructRTLは、データのわずか20%のみで学習した場合でも競争力のある性能を維持し、全データを用いたLLMベースラインを上回った。
産業的評価: 102個の産業用RTLモジュールにおいて、StructRTLは面積ランキングの比較で82.35%、遅延ランキングの比較で**88.23%**の精度を達成した。
推論速度: StructRTLは即時的なフィードバックを提供し、設計あたり平均0.096秒であった。これはロジック合成の13.97秒と比較して、145倍の高速化を実現している。

意義と主張

本論文は、構造的表現学習とクロスステージ監督を組み合わせることで、RTL品質推定における新たな最先端（SOTA）を確立すると主張している。著者らは、CDFGにおける構造的意味論の明示的な符号化と、自己教師あり学習および知識蒸留の組み合わせにより、トークンベースのLLMが見落とす複雑な設計パターンを捉えることが可能になると強調している。このアプローチは、完全な合成の計算負荷を負うことなく、設計サイクルの初期段階で正確かつ早期の品質フィードバックを可能にすることで、設計サイクルを加速するための実用的なソリューションを提供する。本研究は、LLMはコード生成には優れているものの、精密なハードウェア品質推定に必要な明示的な構造的帰納バイアスを欠いている可能性があり、構造グラフ学習がそのギャップを効果的に埋めることを浮き彫りにしている。