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A Power-Efficient and Noise-Resilient Domino Logic Architecture with Adaptive Keeper Control for Wide Fan-In Applications

本論文は、適応型キーパー制御スキームおよびスタック型フッタートランジスタを用いた再構成されたPDNを利用することで、従来の設計と比較して消費電力を大幅に削減し、ノイズマージンを改善し、プロセス変動に対する堅牢性を高める、広ファンイン・アプリケーション向けの電力効率が高くノイズ耐性のあるドミノロジック・アーキテクチャを提案するものである。

原著者： Manoranjan Meher, Preetisudha Meher

公開日 2026-06-24

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CC BY 4.0

原著者： Manoranjan Meher, Preetisudha Meher

原論文は CC BY 4.0 (https://creativecommons.org/licenses/by/4.0/) でライセンスされています。 ✨ これは以下の論文のAI生成解説です。著者が執筆または承認したものではありません。技術的な正確性については原論文を参照してください。免責事項の全文を読む

あなたは、非常に忙しく高速な工場組立ラインを運営していると想像してください。この工場は、驚異的な速さで意思決定を行うように設計されていますが、いくつかの厄介な問題を抱えています。それは、大量の電力を浪費すること、騒音（例えば、部屋の中での突然の叫び声）に惑わされやすいこと、そして静かにしていようとしている時でもエネルギーが漏れてしまうことです。

この論文は、この工場を動かすための、よりスマートな新しい方法を紹介しています。著者である Manoranjan と Preetisudha Meher は、これらの問題を解決する「ドミノ・ロジック」（高速コンピュータチップに使用される電子回路の一種）を設計しました。

以下は、日常的な比喩を用いた、彼らの新しい設計がどのように機能するかについての簡単な解説です。

問題点：「過剰な警備員」と「穴の開いたバケツ」

従来の高速回路（ドミノ・ロジックと呼ばれるもの）には、主に2つの問題があります。

警備員との争い（キーパー・コンテンション）: 警備員（「キーパー」）は、誰も入ってこないようにドアをロックしておくのが仕事だと想像してください。しかし、時として、作業員（「プルダウン・ネットワーク」）が何かを外に出すために、そのドアを開ける必要があります。従来の設計では、作業員がドアを開けようとしている間も、警備員がドアを閉め続けようとします。彼らは押し問答を繰り広げ、これがエネルギーを浪費し、動作を遅らせる原因となります。
穴の開いたバケツ（サブスレッショルド漏れ電流）: 工場が稼働していない時でも、水（電気電荷）を保持しているバケツには小さな穴が開いています。水はゆっくりと漏れ出していきます。もしバケツが大きすぎると（入力が多いと）、水が非常に速く漏れてしまい、工場がミスを起こしてしまいます。

解決策：スマートな警備員と補強されたバケツ

著者らは、これらの問題を解決するために2つの賢明な修正案を提案しています。

1. 「スマートな警備員」（適応型キーパー制御）

常にドアと戦っている警備員の代わりに、彼らの新しい警備員はスマートで条件的です。

仕組み: 警備員は、作業員がドアを開けようとしていない場合にのみ、ドアを閉めるために介入します。もし作業員が仕事をこなすためにドアを開ける必要があるなら、警備員は即座に脇に退き、作業員を通します。
結果: もう押し問答は起きません！これにより、警備員が作業員と戦うために電力を浪費することがなくなるため、膨大な量のエネルギーが節約されます。また、必要な時にドアがすぐに開くため、システムはより高速になります。

2. 「二重底を備えた補強されたバケツ」（修正されたプルダウン・ネットワーク）

水の漏れを防ぐために、彼らはバケツの構造を変更しました。

仕組み: 単一のパイプで水が流れ出るのではなく、その間に特殊なバルブを挟んで、2本のパイプを垂直に積み重ねました。この「積み重ね」が圧力効果を生み出し、自然に小さな漏れをブロックします。
ひねり: 水が流れるべき時にしっかりと流れるように、彼らはもう一本の並行したパイプを追加しました。これは高速道路のバイパスレーンのようなものです。メインの経路が開いているときは、交通量（電気）は速く流れます。しかし、経路が閉じているときは、積み重ねられたパイプが漏れを最小限に抑えます。
結果: バケツは水をより長く保持できます（ノイズ耐性の向上）。しかし、空にする時には以前と同じ速さで空になります。

証明：「128入力マルチプレクサ」テスト

彼らのアイデアが機能することを証明するために、著者らは単なる理論にとどまりませんでした。彼らは大規模なテストケースを作成しました。彼らは128入力マルチプレクサを作成しました。

比喩: 128本の異なる電話回線を持つ巨大な交換機を想像してください。システムは、メインの電話に接続する線を1つ選ぶ必要があります。128本の線を一度にこれを行うことは、通常、非常に乱雑で、遅く、電力を消費します。
テスト: 彼らは、この新しい「スマートな警備員」と「補強されたバケツ」のデザインを用いてこの交換機を構築し、従来の標準的なデザインと比較しました。

結果：彼らは何を発見したのか？

彼らが90ナノメートル・チップ設計で数値を走らせたところ、結果は素晴らしいものでした。

電力節約: 新しい設計は、34%少ない電気を使用しました。これは、同じ作業を行いながら、電気代を大幅に安く抑えられるようなものです。
ノイズ耐性: ノイズを無視する能力が54%向上しました。もし誰かが工場の近くで叫んでも、新しいシステムは混乱しませんが、古いシステムはミスをする可能性があります。
効率性: 彼らは「電力遅延積（パワー・ディレイ・プロダクト）」（速度とエネルギーを組み合わせたスコア）を測定しました。新しい設計は33%優れたスコアを記録し、全体としてより効率的であることを示しました。
信頼性: 温度が変化したり、製造工程にばらつきがあったりしても、新しい設計は安定していました。古い設計ほど簡単に故障することはありませんでした。

まとめ

著者らは、コンポーネント同士の衝突を防ぎ、エネルギーを浪費する小さな漏れを塞ぐ、よりスマートな電子回路を作り上げました。これを行うことで、彼らはシステムをより高速にし、消費電力を抑え、ノイズに惑わされにくくしました。彼らは、この設計が伝統的なデザインのあらゆる主要なカテゴリーにおいて、それを凌駕することを、巨大な128ラインの交換機を構築することで証明しました。

これは、携帯機器や高速コンピュータの未来にとって大きな勝利です。なぜなら、これにより、デバイスがより涼しく、単一のバッテリー充電でより長く動作できるようになるからです。

技術要約：広範なファンイン・アプリケーションに向けた、適応型キーパー制御を備えた低消費電力かつノイズ耐性の高いドミノ・ロジック・アーキテクチャ

問題提起
従来のドミノ・ロジック・ゲート（DLG）は、そのコンパクトなレイアウトと静的ロジックと比較して寄生容量が低いことから、特に広範なファンイン（wide fan-in）アプリケーションにおいて、高速VLSI回路で広く利用されています。しかし、CMOS技術がナノメートルノード（例：90 nm）へとスケールダウンするにつれ、DLGは重大な課題に直面しています。供給電圧および閾値電圧（ $V_{th}$ ）の低下は、サブスレッショルド漏れ電流の著しい増加を招き、これがダイナミック・ノードを放電させ、ノイズマージンを劣化させ、論理エラーを引き起こす可能性があります。さらに、広範なファンイン・ゲートは、チャージシェアリング（電荷共有）や、プルダウン・ネットワーク（PDN）とキーパー・トランジスタ間のコンテンション（競合）を悪化させます。キーパーのサイズを大きくすればノイズ耐性は向上しますが、これは評価フェーズにおける深刻なコンテンション電流を導入し、結果として消費電力の増大、遅延の増加、およびプロセス変動への敏感さを引き起こします。高速度型または条件付きキーパー・アーキテクチャなどの既存の解決策は、堅牢性と速度のトレードオフが生じたり、過大な面積オーバーヘッドを伴ったりするか、あるいは大規模なファンイン構成における漏れ電流を十分に抑制できなかったりします。

手法
著者らは、評価速度を損なうことなく、消費電力、漏れ電流、およびノイズ耐性を同時に解決するように設計された、修正されたドミノ・ロジック・ゲート（DLG）アーキテクチャを提案しています。Cadence Virtuosoを用いた90 nm CMOS技術によるシミュレーションを用いたこの設計には、主に2つの革新的な要素が含まれています。

条件付きキーパー・ネットワーク： 評価フェーズを通じて常にアクティブである従来の静的キーパーとは異なり、提案されたアーキテクチャは、クロックおよびデータに依存する条件付きキーパーを採用しています。このネットワークは、ダイナミック・ノードが充電されているとき（能動的な放電パスが存在しないことを示す）かつクロックが評価フェーズにあるときにのみ有効になります。有効な放電パスがPDN内に確立されると、キーパーは即座に無効化されます。このメカニズムにより、有効な論理遷移中のキーパーとPDNの間のコンテンション電流が排除され、ノードが高く維持されるべきときのリークに対するダイナミック・ノードの安定性を維持しつつ、動的な消費電力を削減できます。
修正プルダウン・ネットワーク（PDN）： サブスレッショルド漏れ電流とチャージシェアリングを軽減するために、PDNはスタックされたフッター・トランジスタ構成を用いて再構築されています。2つのNMOSトランジスタが、フッター・トランジスタと直列に接続された並列の評価パスを形成します。このスタックされたフッターはボディ効果を誘起し、上部トランジスタのソース電位を上昇させ、実効閾値電圧（ $V_{TH,eff}$ ）を高めることで、サブスレッショルド漏れ電流を指数関数的に抑制します。スタックされたトランジスタに伴う遅延ペナルティに対処するため、追加の放電パスを提供する並列トランジスタが導入されており、これにより評価速度が維持されます。

主な貢献

適応型キーパー制御： キーパー有効化条件として $CLK \cdot \overline{PDN_{ON}}$ を定義することで、有効な放電イベント中のキーパーとPDNのコンテンションを完全に抑制しました。
リーク配慮型PDNトポロジー： ボディ効果による変調を介したリーク抑制のためのスタック・フッターと、評価抵抗を最小限にするための並列パスを組み合わせたハイブリッドPDN構造。
最適化されたトレードオフ： 本アーキテクチャは、広範なファンインORロジック・アプリケーションを標的として、電力効率、ノイズ耐性、および速度の間で良好なバランスを実現しています。

結果
提案された設計は、8、16、32、および64入力構成において、いくつかの既存のドミノ・ロジック・アーキテクチャ（SFDLG、DFDLG、HSDLG、VCDLG、VRKDLG、DOINDLG、FDSTDLG、およびLPDLGを含む）と比較して評価されました。32入力ORゲートに関する主なシミュレーション結果は以下の通りです。

消費電力： 従来のSFDLGと比較して、平均消費電力が34%減少。
ノイズ耐性： ノイズマージン（Unity Noise Gain Average, UNAにより測定）が54%向上。
エネルギー効率： 電力遅延積（PDP）およびエネルギー遅延積（EDP）の両方において33%の削減。
堅牢性： プロセス、電圧、温度（PVT）の変動に対する耐性が向上し、参照設計と比較して遅延と電力の標準偏差が低くなりました。
マルチプレクサの実装： アプローチを検証するために、128ビット幅のファンイン・マルチプレクサを実装しました。提案された設計は、従来のドミノ型マルチプレクサと比較して、面積のわずかな増加（1.102倍）のみで、電力の32%削減、ノイズマージンの21%向上、およびPDPとEDPの32%削減を達成しました。

意義
本論文は、提案されたアーキテクチャが、メモリのビットライン選択やスーパースカラー・マイクロプロセッサのデータパスなど、現代のエネルギー効率の高い広範なファンイン・ダイナミック・ロジック・アプリケーションに対して優れたソリューションを提供すると主張しています。ノイズの堅牢性とコンテンションに起因する消費電力のトレードオフを効果的に切り離すことにより、本設計は、大幅な面積や速度のペナルティを課すことなく、リークやプロセス変動に対して耐性を持つ高性能なロジック・ゲートを可能にします。128ビット・マルチプレクサの成功した実装は、複雑で大規模なVLSIシステムにおける提案された適応型キーパーおよび修正PDN戦略の拡張性と実用的な適用可能性をさらに裏付けています。